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參數(shù)資料
| 型號(hào)： | XE8802MI035LF |
| 廠商： | Semtech |
| 文件頁(yè)數(shù)： | 71/193頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC DAS 16BIT FLASH 8K 100-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | XE880x |
| 應(yīng)用： | 感測(cè)機(jī) |
| 核心處理器： | Coolrisc816? |
| 程序存儲(chǔ)器類型： | 閃存（22 kB） |
| 控制器系列： | XE8000 |
| RAM 容量： | 1K x 8 |
| 接口： | SPI，UART |
| 輸入/輸出數(shù)： | 36 |
| 電源電壓： | 2.4 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 產(chǎn)品目錄頁(yè)面： | 585 (CN2011-ZH PDF) |
| 配用： | XE8000MP-ND - PROG BOARD AND PROSTART2 CARD |
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)當(dāng)前第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)
Semtech 2006
www.semtech.com
19-18
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
multpilexing
V0
V1
V2
V3
direct drive
used
-
used
1:2
used
-
used
1:3
used
1:4
used
Table 19-22. V0, V1, V2, V3 usage in the LCD driver
19.5.4.1
Generating LCD voltage with the internal multiplier/divider.
To generate LCD voltage with the internal multiplier/divider, some external capacitors have to be connected to the
circuit. The value of the capacitor
aux
C
can be calculated depending on the output impedance that is required on
the V3 voltage:
3
6
outV
vgen
aux
Z
f
C
with
vgen
f
the operating frequency of the multiplier/divider (set by the bits VgenClkSel in RegVgenCfg0, see Table
19-23) and
3
outV
Z
the required output impedance of V3. The equation is valid for
aux
C
<5
F.
Note that the operating frequency depends on the selected clock source (see clock block documen-tation).
For a capacitor
aux
C
of 470nF and a frequency of 1024Hz (default value), an output impedance of 12k
is
obtained. The capacitors CLCD1, CLCD2 and CLCD3 can be chosen equal to
aux
C
.
VgenClkSel
vgen
f
(Hz)
00
256
01
512
10
1024
11
2048
Table 19-23. multplier/divider operating frequency
To enable the voltage multiplier/divider, the bits VgenOff and VgenStdb in RegVgenCfg0 are set to 0. The
difference between the two bits is that VgenOff stops the generator and forces the nodes pad_vgen_v1,
pad_vgen_v2, pad_vgen_v3, pad_vgen_va and pad_vgen_vb to predefined values and therefor discharges the
capacitors CLCD1, CLCD2 and CLCD3. The bit VgenStdb only stops the operating clock without changing the voltage
on CLCD1, CLCD2 and CLCD3. The capacitors will be discharged by leakage and by the switching of the LCD if the bit
LcdSleep is not set.
The multiplier/divider can generate 1/2 bias (VgenMode=1 in RegVgenCfg0) or 1/3 bias (VgenMode=0 in
RegVgenCfg0).
Finally, the multiplier/divider can use the internal 1.2V bandgap reference (VgenRefEn=1 in RegVgenCfg0) or an
external reference (VgenRefEn=0 in RegVgenCfg0). The internal voltage reference can not be used in case the
circuit voltage supply is below 1.5V.
Figure 19-12 shows the external connections to be made in 1/3 bias mode.
Part (a) of the figure shows the use
of the internal voltage reference. In this case, V1=1.2V, V2=2.4V and V3=3.6V. Part (b) of the figure shows the use
of an external voltage reference. The external reference can be connected to one of the pins pad_vgen_v1,
pad_vgen_v2, pad_vgen_v3. Table 19-24 shows the voltage generated on V1, V2, V3 depending on the
connection of the external reference voltage Vext. The external voltage may or may not be identical to the circuit
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