參數(shù)資料
型號(hào)： XE8802MI035LF
廠商： Semtech
文件頁數(shù)： 9/193頁
文件大小： 0K
描述： IC DAS 16BIT FLASH 8K 100-LQFP
標(biāo)準(zhǔn)包裝： 90
系列： XE880x
應(yīng)用： 感測(cè)機(jī)
核心處理器： Coolrisc816?
程序存儲(chǔ)器類型： 閃存（22 kB）
控制器系列： XE8000
RAM 容量： 1K x 8
接口： SPI，UART
輸入/輸出數(shù)： 36
電源電壓： 2.4 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-LQFP
包裝： 托盤
供應(yīng)商設(shè)備封裝： 100-LQFP（14x14）
產(chǎn)品目錄頁面： 585 (CN2011-ZH PDF)
配用： XE8000MP-ND - PROG BOARD AND PROSTART2 CARD
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Semtech 2006
www.semtech.com
16-3
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
Block configuration registers:
pos.
RegSpiControl
Rw
Reset
Function
7
ClearCounter
w1
-
Writing 1 clears transmission control counters.
6
NotSlaveSelect
r/w
1 nresetglobal
In master mode, this bit drives the NSS output
pad. Unused in slave mode. It must be
asserted (to 0) during a byte transfer.
5
SpiMaster
r/w
1 nresetglobal
0: SPI slave mode.
1: SPI master mode.
4
SpiEnable
r/w
0 nresetglobal
peripheral configuration:
0: general purpose digital I/O port
1: SPI interface
3
ClockPhase
r/w
1 nresetglobal
Controls the timing relationship between the
serial clock and SPI data (cf. Figure 16-2 and
Figure 16-3).
2
ClockPolarity
r/w
0 nresetglobal
Determines the idle-state of the SPI clock
signal (cf. Figure 16-2 and Figure 16-3).
1-0
BaudRate
r/w
00
nresetglobal
Selects the baud rate in master mode.
00 => ckRcExt/2
01 => ckRcExt/8
10 => ckRcExt/16
11 => 4kHz
Table 16-3: RegSpiControl
Note that the precision of the 4kHz depends on the selected clock source (see documentation of the clock block).
In slave mode, the fastest clock of the circuit should be at least 4 times faster than the baud rate of the master.
pos.
RegSpiStatus
Rw
Reset
Function
7-3
--
r
00000
Unused
2
SpiOverflow
r
c1
0
nresetglobal
This flag is set when a new byte is loaded in
SpiDataIn before the previous byte was read.
Writing 1 clears the flag.
1
SpiRxFull
r
0
nresetglobal
This flag is set each time a byte transfers from
the shift register to SpiDataIn. It is cleared by
reading SpiDataIn.
0
SpiTxEmpty
r
w1
1
nresetglobal
This flag is cleared each time the CPU writes a
byte in SpiDataOut. It is set when a byte
transfers from SpiDataOut to the shift register.
In the master mode, writing 1 to this bit
performs the data transfer SpiDataOut to the
shift
register
and
enables
the
start
of
transmission.
In the slave mode, the byte transfer is done
automatically except for the very first byte
after nresetglobal (cf.16.6 Software hints).
Table 16-4: RegSpiStatus
Pos.
RegSpiDataOut
Rw
Reset
Function
7-0
SpiDataOut[7:0]
r/w
00000000
nresetglobal
SPI mode: transmission data buffer
I/O mode: output data (only bits 3:0, see Table
16-2)
Table 16-5: RegSpiDataOut
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