參數(shù)資料
型號: XR16L784CV
廠商: EXAR CORP
元件分類: 微控制器/微處理器
英文描述: HIGH PERFORMANCE 2.97V TO 5.5V QUAD UART
中文描述: 4 CHANNEL(S), 6.25M bps, SERIAL COMM CONTROLLER, PQFP64
封裝: 10 X 10 MM, 1.40 MM HEIGHT, LQFP-64
文件頁數(shù): 47/52頁
文件大?。?/td> 625K
代理商: XR16L784CV
á
REV. 1.2.0
XR16L784
HIGH PERFORMANCE 2.97V TO 5.5V QUAD UART
47
F
IGURE
22. T
RANSMIT
I
NTERRUPT
T
IMING
[N
ON
-FIFO M
ODE
]
F
IGURE
23. R
ECEIVE
I
NTERRUPT
T
IMING
[FIFO M
ODE
]
F
IGURE
24. T
RANSMIT
I
NTERRUPT
T
IMING
[FIFO M
ODE
]
TX
(Unloading)
IOW #
(Loading data
into THR)
INT#*
D0:D7
Start
Bit
D0:D7
Stop
Bit
D0:D7
T
W RI
T
W RI
T
W RI
*TX interrupt is cleared when the ISR is read or when data is loaded into the THR.
ISR is read
ISR is read
ISR is read
IER[1]
enabled
RX
IOR#
(Reading data out
of RX FIFO)
INT#
D0:D7
S
RX FIFO fills up to RX
Trigger Level or RX Data
Timeout
RX FIFO drops
below RX
Trigger Level
D0:D7
S
D0:D7
T
D0:D7
S
D0:D7
S
T
D0:D7
S
T
T
D0:D7
S
T
Start
Bit
T
RR
T
RRI
T
SSI
TX
IOW#
(Loading data
into FIFO)
INT#*
D0:D7
S
D0:D7
T
D0:D7
S
D0:D7
S
T
D0:D7
S
T
T
D0:D7
S
T
Start
Bit
Stop
Bit
(Unloading)
Last Data Byte
Transmitted
TX FIFO fills up
to trigger level
TX FIFO drops
below trigger level
TX FIFO
Empty
T
T
S
T
SI
ISR is read
IER[1]
enabled
ISR is read
*TX interrupt is cleared when the ISR is read or when TX FIFO fills up to the trigger level.
T
WRI
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PDF描述
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XR16L784IV 制造商:EXAR 制造商全稱:EXAR 功能描述:HIGH PERFORMANCE 2.97V TO 5.5V QUAD UART