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參數(shù)資料
| 型號： | XRT72L54 |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA272 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-272 |
| 文件頁數(shù)： | 171/484頁 |
| 文件大小： | 5949K |
| 代理商： | XRT72L54 |
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á
PRELIMINARY
FOUR CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
XRT72L54
REV. P1.1.2
152
Operation of the Transmit Payload Data Input In-
terface
The Transmit Payload Data Input Interface is extreme-
ly flexible, in that it permits the user to make the fol-
lowing configuration options.
The Serial or the Nibble-Parallel Interface Mode
The Loop-Timing or the TxInClk (Local Timing)
Mode
Further, if the XRT72L54 has been configured to op-
erate in the TxInClk (Local Timing) mode, then the
user has two additional options.
The XRT72L54 functions as the Frame Master
(e.g., it dictates when the Terminal Equipment will
initiate the transmission of data within a new DS3
frame).
The XRT72L54 functions as the Frame Slave (e.g.,
the Terminal Equipment will dictate when the
XRT72L54 initiates the transmission of a new DS3
frame).
Given these three set of options, the Transmit Termi-
nal Input Interface can be configured to operate in
one of the six (6) following modes.
Mode 1 - Serial/Loop-Timed Mode
Mode 2 - Serial/Local-Timed/Frame Slave Mode
Mode 3 - Serial/Local-Timed/Frame Master Mode
Mode 4 - Nibble/Loop-Timed Mode
Mode 5 - Nibble/Local-Timed/Frame Slave Mode
Mode 6 - Nibble/Local-Timed/Frame Master Mode
Each of these modes are described, in detail, below.
4.2.1.1
Mode 1 - The Serial/Loop-Timing Mode
The Behavior of the XRT72L54
If the XRT72L54 has been configured to operate in
this mode, then the XRT72L54 will behave as follows.
A. Loop-Timing (Uses the RxLineClk signal as the
Timing Reference)
Since the XRT72L54 is configured to operate in the
loop-timed mode, the Transmit Section (of the
XRT72L54) will use the RxLineClk input clock signal
(e.g., the Recovered Clock signal, from the LIU) as its
timing source. When the XRT72L54 is operating in
this mode it will do the following.
1.
It will ignore any signal at the TxInClk input pin.
2.
The XRT72L54 will output a 44.736MHz clock
signal via the RxOutClk output pin. This clock
signal functions as the Transmit Payload Data
Input Interface block clock signal.
3.
The XRT72L54 will use the rising edge of the
RxOutClk signal to latch in the data residing on
the TxSer input pin.
B. Serial Mode
The XRT72L54 will accept the DS3 payload data from
the Terminal Equipment, in a serial-manner, via the
TxSer input pin The Transmit Payload Data Input In-
terface block will latch this data into its circuitry, on the
rising edge of the RxOutClk output clock signal.
C. Delineation of outbound DS3 frames
The XRT72L54 will pulse the TxFrame output pin
"High" for one bit-period coincident with the
XRT72L54 processing the last bit of a given DS3
frame.
D. Sampling of Payload Data, from the Terminal
Equipment
In Mode 1, the XRT72L54 will sample the data at the
TxSer input, on the rising edge of RxOutClk.
Interfacing the Transmit Payload Data Input Inter-
face block (of the XRT72L54) to the Terminal
Equipment for Mode 1 Operation
TxFrameRef
Input
Transmit Frame Reference Input:
The XRT72L54 permits the user to configure the Transmit Section to use this input pin as a
frame reference. If the user makes this configuration selection, then the Transmit Section will
initiate its transmission of a new DS3 frame, upon the rising edge of this signal.
The purpose of this input pin is to permit the Terminal Equipment to maintain Transmit DS3
Framing alignment control over the XRT72L54.
RxOutClk
Output
Loop-Timed Timing Reference Clock Output pin:
The Transmit Section of the XRT72L54 can be configured to use the RxLineClk signal as the
Timing Reference (e.g., loop-timing). If the user has made this configuration selection, then
the XRT72L54 will:
Output a 44.736 MHz clock signal via this pin, to the Terminal Equipment.
Sample the data on the TxSer input pin, upon the rising edge of this clock signal.
T
ABLE
19: L
ISTING
AND
D
ESCRIPTION
OF
THE
PINS
ASSOCIATED
WITH
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
S
IGNAL
N
AME
T
YPE
D
ESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT72L56IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L56 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L58IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L58 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L71 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT72L54ES-PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC with T73LC04A+T71D04 RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L54IB | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L56 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SIX CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
| XRT72L56ES-PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L56IB | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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