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參數(shù)資料
| 型號： | XS1-G02B-FB144-I4 |
| 廠商： | XMOS |
| 文件頁數(shù)： | 7/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT 16KB OTP 144FBGA |
| 標(biāo)準(zhǔn)包裝： | 176 |
| 系列： | XS1 |
| 核心處理器： | XCore |
| 芯體尺寸： | 32 位雙核 |
| 速度： | 400MHz |
| 連通性： | USB |
| 輸入/輸出數(shù)： | 88 |
| 程序存儲器容量： | 16KB（4K x 32） |
| 程序存儲器類型： | OTP |
| RAM 容量： | 32K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 0.95 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 144-FBGA |
| 包裝： | 托盤 |
| 其它名稱： | 880-1007 |
XS1-G02B-FB144 Datasheet
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example, a 4.7 resistor and 1 F multi-layer ceramic capacitor) is recommended
on this pin.
The SS_OTP_VPP supply can be optionally provided for faster OTP programming
times, otherwise an internal charge pump is used.
The following ground pins are provided:
PLL_AGND for PLL_AVDD
GND for all other supplies
All ground pins must be connected directly to the board ground.
The VDD and IO VDD supplies should be decoupled close to the chip by several
100 nF low inductance multi-layer ceramic capacitors between the supplies and
GND (for example, 4x100nF 0402 low inductance MLCCs per supply rail). The
ground side of the decoupling capacitors should have as short a path back to the
GND pins as possible. A bulk decoupling capacitor of at least 10 uF should be
placed on each of these supplies.
SS_RESET is an active-low asynchronous-assertion global reset signal. Following a
reset, the PLL re-establishes lock after which the device boots up according to the
boot mode (see §5.8). SS_RESET and must be asserted low during and after power
up for 100 ns.
Document Number: 1100C
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