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參數(shù)資料
| 型號： | μPD703008 |
| 廠商： | NEC Corp. |
| 英文描述： | 16/32 Bit RISC Microcontrollers(16/32位RISC微控制器) |
| 中文描述： | 16/32位RISC微控制器（16/32位的RISC微控制器） |
| 文件頁數(shù)： | 110/141頁 |
| 文件大小： | 374K |
| 代理商： | ΜPD703008 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁當前第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁
CHAPTER 6 INTERRUPT AND EXCEPTION
98
6.2.2 Exception trap
The exception trap is an interrupt requested when an instruction is illegally executed. The exception trap of the
V850 family is generated by an illegal op code instruction code trap (ILGOP: ILleGal OPcode trap).
An illegal op code instruction has an instruction code with an op code (bits 5 through 10) of 111111B and a sub-
op code (bits 23 through 26) of 0011B through 1111B. When this kind of an illegal op code instruction is executed,
an illegal op code instruction code trap occurs.
Figure 6-4. Illegal Instruction Code
Remark
×
: don’t care
: Op code/sub-op code portion
If an exception trap occurs, the CPU performs the following steps, and transfers control to the handler routine.
(1) Saves restore PC to EIPC.
(2) Saves current PSW to EIPSW.
(3) Writes exception code to lower 16 bits (EICC) of ECR.
(4) Sets EP and ID bits of PSW.
(5) Sets handler address (00000060H) for exception trap to PC and transfers control.
Figure 6-5 illustrates how the exception trap is processed.
Figure 6-5. Exception Trap Processing Format
The execution address of the illegal instruction is obtained by “restore PC - 4” when an exception trap occurs.
Caution In addition to the defined op codes and illegal op codes, there is a range of codes not recognized
by this processor. If an instruction corresponding to these codes is executed, normal operation
is undetermined.
EIPC
EIPSW
ECR.EICC
PSW.EP
PSW.ID
PC
←
←
←
←
←
←
Restore PC
PSW
Exception code
1
1
00000060H
Exception Trap
(ILGOP) Occurs
Exception Processing
× × ×
× ×
×
× ×
× × ×
× ×
× ×
0
0
1
1
1
1
1
1
× × × ×
× × ×
15
13 12 11 10
5
4
0 31
27 26
23 22 21 20
17 16
1
1
1
1
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