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參數(shù)資料
| 型號： | μPD78P0308 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8 Bit Single Chip Microcontrollers |
| 中文描述： | 8位單片機微控制器 |
| 文件頁數(shù)： | 42/70頁 |
| 文件大?。?/td> | 556K |
| 代理商： | ΜPD78P0308 |
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42
μ
PD78P0308
Preliminary Data Sheet
(iii) SBI mode (SCK0... Internal clock output)
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCK0 cycle time
t
KCY3
V
DD
= 4.5 to 5.5 V
800
ns
3200
ns
SCK0 high-/low-level width
t
KH3
,
V
DD
= 4.5 to 5.5 V
t
KCY3
/2 – 50
ns
t
KL3
t
KCY3
/2 – 150
ns
SB0, SB1 setup time
t
SIK3
V
DD
= 4.5 to 5.5 V
100
ns
(to SCK0
↑
)
300
ns
SB0, SB1 hold time
t
KSI3
t
KCY3
/2
ns
(from SCK0
↑
)
SB0, SB1 output delay
t
KSO3
R = 1 k
,
V
DD
= 4.5 to 5.5 V
0
250
ns
time from SCK0
↓
C = 100 pF
Note
0
1000
ns
SB0, SB1
↓
from SCK0
↑
t
KSB
t
KCY3
ns
SCK0
↓
from SB0, SB1
↓
t
SBK
t
KCY3
ns
SB0, SB1 high-level width
t
SBH
t
KCY3
ns
SB0, SB1 low-level width
t
SBL
t
KCY3
ns
Note
R and C are the load resistance and load capacitance of the SCK0, SB0, and SB1 output lines.
(iv) SBI mode (SCK0... External clock input)
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCK0 cycle time
t
KCY4
V
DD
= 4.5 to 5.5 V
800
ns
3200
ns
SCK0 high-/low-level width
t
KH4
,
V
DD
= 4.5 to 5.5 V
400
ns
t
KL4
1600
ns
SB0, SB1 setup time
t
SIK4
V
DD
= 4.5 to 5.5 V
100
ns
(to SCK0
↑
)
300
ns
SB0, SB1 hold time
t
KSI4
t
KCY4
/2
ns
(from SCK0
↑
)
SB0, SB1 output delay
t
KSO4
R = 1 k
,
V
DD
= 4.5 to 5.5 V
0
300
ns
time from SCK0
↓
C = 100 pF
Note
0
1000
ns
SB0, SB1
↓
from SCK0
↑
t
KSB
t
KCY4
ns
SCK0
↓
from SB0, SB1
↓
t
SBK
t
KCY4
ns
SB0, SB1 high-level width
t
SBH
t
KCY4
ns
SB0, SB1 low-level width
t
SBL
t
KCY4
ns
SCK0 rising/falling time
t
R4
,
1000
ns
t
F4
Note
R and C are the load resistance and load capacitance of the SB0 and SB1 output lines.
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PDF描述 |
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