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參數(shù)資料
型號(hào)： 5CGXFC7C7U19C8NES
廠商： Altera
文件頁(yè)數(shù)： 269/1077頁(yè)
文件大?。?/td> 0K
描述： IC CYCLONE V FPGA 150K 484-UBGA
標(biāo)準(zhǔn)包裝： 84
系列： Cyclone® V GX
LAB/CLB數(shù)： 56415
邏輯元件/單元數(shù)： 149500
RAM 位總計(jì)： 6656000
輸入/輸出數(shù)： 240
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-FBGA
供應(yīng)商設(shè)備封裝： 484-UBGA（19x19）
其它名稱： 544-2740
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To perform BST during configuration, issue CONFIG_IO JTAG instruction to interrupt configuration.
While configuration is interrupted, you can issue other JTAG instructions to perform BST. After BST is
completed, issue the PULSE_CONFIG JTAG instruction or pulse nCONFIG low to reconfigure the device.
The chip-wide reset (DEV_CLRn) and chip-wide output enable (DEV_OE) pins on Cyclone V devices do not
affect JTAG boundary-scan or configuration operations. Toggling these pins does not disrupt BST operation
(other than the expected BST behavior).
If you design a board for JTAG configuration of Cyclone V devices, consider the connections for the dedicated
configuration pins.
Do not cascade JTAG chains for FPGA and HPS together when you are performing BST. The JTAG
for HPS does not support BST.
Note:
Related Information
Provides more information about pin connections.
Provides more information about JTAG configuration.
Provides more information about JTAG configuration timing.
Enabling and Disabling IEEE Std. 1149.1 BST Circuitry
The IEEE Std. 1149.1 BST circuitry is enabled after the Cyclone V device powers up. However for Cyclone V
SoC FPGAs, you must power up both HPS and FPGA to perform BST.
To ensure that you do not inadvertently enable the IEEE Std. 1149.1 circuitry when it is not required, disable
the circuitry permanently with pin connections as listed in the following table.
Table 9-4: Pin Connections to Permanently Disable the IEEE Std. 1149.1 Circuitry for Cyclone V Devices
Connection for Disabling
JTAG Pins
(23)
VCCPD supply of Bank 3A
TMS
GND
TCK
VCCPD supply of Bank 3A
TDI
Leave open
TDO
(23) The JTAG pins are dedicated. Software option is not available to disable JTAG in Cyclone V devices.
JTAG Boundary-Scan Testing in Cyclone V Devices
Altera Corporation
CV-52009
Enabling and Disabling IEEE Std. 1149.1 BST Circuitry
9-8
2014.01.10
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