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參數(shù)資料
型號(hào)： 5CGXFC7D7F27C8NES
廠商： Altera
文件頁(yè)數(shù)： 1027/1077頁(yè)
文件大?。?/td> 0K
描述： IC CYCLONE V FPGA 150K 672-FBGA
標(biāo)準(zhǔn)包裝： 40
系列： Cyclone® V GX
LAB/CLB數(shù)： 56415
邏輯元件/單元數(shù)： 149500
RAM 位總計(jì)： 6656000
輸入/輸出數(shù)： 336
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 672-BGA
供應(yīng)商設(shè)備封裝： 672-FBGA（27x27）
其它名稱： 544-2739
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Transmit and receive buffers
Handles bit and byte waiting at all bus speeds
DMA handshaking interface
I
2C Controller Block Diagram and System Integration
The I
2C controller consists of a slave interface, an I2C interface, and FIFO logic to buffer data between the
two interfaces.
The host processor accesses data, control, and status information about the I
2C controller through a 32-bit
slave interface.
Figure 20-1: I2C Controller Block Diagram
RX and RX FIFO
TX and RX Shift
RX Filter
Control
Interrupt Controller
DMA Interface
Clock
Manager
Reset
Manager
DMA
Controller
MPU
IRQ
I2C Controller
I2C Interface
(to I/O Pins)
Register Block
Slave Interface
L4 Peripheral Bus
The I
2C controller consists of the following modules and interfaces:
Slave interface for control and status register (CSR) accesses and DMA transfers, allowing a master to
access the CSRs and the DMA to read or write data directly.
Two FIFO buffers for transmit and receive data, which hold the Rx FIFO and Tx FIFO buffer register
banks and controllers, along with their status levels.
Shift logic for parallel-to-serial and serial-to-parallel conversion
Rx shift – Receives data into the design and extracts it in byte format.
Tx shift – Presents data supplied by CPU for transfer on the I
2C bus.
Control logic responsible for implementing the I
2C protocol.
I2C Controller
Altera Corporation
cv_54020
I
2C Controller Block Diagram and System Integration
20-2
2013.12.30
相關(guān)PDF資料
PDF描述
ACM43DTAN CONN EDGECARD 86POS R/A .156 SLD
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相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
5CGXFC7D7F31C8N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V GX 5648 LABs 480 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
5CGXFC7D7F31C8NES 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V GX 5648 LABs 480 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
5CGXFC9A6U19A7N 功能描述:IC FPGA 240 I/O 484UBGA 制造商:altera 系列:Cyclone? V GX 零件狀態(tài):有效 LAB/CLB 數(shù):113560 邏輯元件/單元數(shù):301000 總 RAM 位數(shù):14251008 I/O 數(shù):240 柵極數(shù):- 電壓 - 電源:1.07 V ~ 1.13 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C （TJ） 封裝/外殼:484-FBGA 供應(yīng)商器件封裝:484-UBGA（19x19） 標(biāo)準(zhǔn)包裝:84
5CGXFC9A6U19C7N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Cyclone V GX 113560 LABs 560 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
5CGXFC9A6U19I7 功能描述:IC FPGA 240 I/O 484UBGA 制造商:altera 系列:Cyclone? V GX 零件狀態(tài):有效 LAB/CLB 數(shù):113560 邏輯元件/單元數(shù):301000 總 RAM 位數(shù):14251008 I/O 數(shù):240 柵極數(shù):- 電壓 - 電源:1.07 V ~ 1.13 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C（TJ） 封裝/外殼:484-FBGA 供應(yīng)商器件封裝:484-UBGA（19x19） 標(biāo)準(zhǔn)包裝:84
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