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參數(shù)資料
| 型號： | 82845Gx |
| 廠商： | Intel Corp. |
| 英文描述： | Intel 82845G/82845GL/82845GV Graphics and Memory Controller Hub (GMCH) |
| 中文描述： | 英特爾82845G/82845GL/82845GV圖形和內(nèi)存控制器中樞（GMCH） |
| 文件頁數(shù)： | 101/193頁 |
| 文件大小： | 2990K |
| 代理商： | 82845GX |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁當(dāng)前第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁
Intel
82845G/82845GL/82845GV GMCH Datasheet
101
Register Description
3.5.3.21
PMCAP—Power Management Capabilities Register (Device 2)
Address Offset:
Default Value:
Access:
Size:
D2h
D3h
0021h
RO
16 bits
3.5.3.22
PMCS—Power Management Control/Status Register (Device 2)
Address Offset:
Default Value:
Access:
Size:
D4h
D5h
0000h
R/W, RO
16 bits
Bit
Description
15:11
PME Support.
Hardwired to 0. This field indicates the power states in which the IGD may assert
PME#. The IGD does not assert the PME# signal.
10
D2.
Hardwired to 0. The D2 power management state is not supported.
9
D1.
Hardwired to 0. The D1 power management state is not supported.
8:6
Reserved. Read as zeros.
5
Device Specific Initialization (DSI).
Hardwired to 1 to indicate that special initialization of the IGD is
required before generic class device driver is to use it.
4
Auxiliary Power Source.
Hardwired to 0.
3
PME Clock.
Hardwired to 0. The IGD does not support PME# generation.
2:0
Version.
Hardwired to 001b to indicate there are 4 bytes of power management registers
implemented.
Bit
Description
15
PME_Status—RO.
Hardwired to 0. The IGD does not support PME# generation from D3 (cold).
14:13
Data Scale (Reserved)—RO.
Hardwired to 0. The IGD does not support data register.
12:9
Data_Select (Reserved)—RO.
Hardwired to 0. The IGD does not support data register.
8
PME_En—RO.
Hardwired to 0. PME# assertion from D3 (cold) is disabled.
7:2
Reserved.
Always returns 0 when read, write operations have no effect.
1:0
PowerState—R/W.
This field indicates the current power state of the IGD and can be used to set the
IGD into a new power state. If software attempts to write an unsupported state to this field, the write
operation must complete normally on the bus, but the data is discarded and no state change occurs.
00 = D0 (Default)
01 = D1 Not Supported– Writes will be blocked and will return the previous value.
10 = D2 Not Supported– Writes will be blocked and will return the previous value.
11 = D3
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PDF描述 |
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