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參數(shù)資料
| 型號： | A3P1000-1PQ208IPQ208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 1000000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 354/608頁 |
| 文件大小： | 20486K |
| 代理商： | A3P1000-1PQ208IPQ208 |
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v1.1
10- 1
Pin Descriptions
10 – Pin Descriptions
Supply Pins
GND
Ground
Ground supply voltage to the core, I/O outputs, and I/O logic.
GNDQ
Ground (quiet)
Quiet ground supply voltage to input buffers of I/O banks. Within the package, the GNDQ plane is
decoupled from the simultaneous switching noise originated from the output buffer ground
domain. This minimizes the noise transfer within the package and improves input signal integrity.
GNDQ must always be connected to GND on the board.
VCC
Core Supply Voltage
Supply voltage to the FPGA core, nominally 1.5 V for ProASIC3/E devices, 1.5 V for IGLOO/e V5
devices, and 1.2 V or 1.5 V for IGLOO/e V2 and ProASIC3L devices. VCC is required for powering the
JTAG state machine in addition to VJTAG. Even when a device is in bypass mode in a JTAG chain of
interconnected devices, both VCC and VJTAG must remain powered to allow JTAG signals to pass
through the device.
For IGLOO/e V2 and ProASIC3L devices, VCC can be switched dynamically from 1.2 V to 1.5 V or vice
versa. This allows in-system programming (ISP) when VCC is at 1.5 V and the benefit of low-power
operation when VCC is at 1.2 V.
VCCIBx
I/O Supply Voltage
Supply voltage to the bank's I/O output buffers and I/O logic. Bx is the I/O bank number. There are
up to eight I/O banks on low-power flash devices plus a dedicated VJTAG bank. Each bank can have
a separate VCCI connection. All I/Os in a bank will run off the same VCCIBx supply. VCCI can be 1.2 V
(not supported on ProASIC3/E devices), 1.5 V, 1.8 V, 2.5 V, or 3.3 V, nominal voltage. Unused I/O
banks should have their corresponding VCCI pins tied to GND.
VMVx
I/O Supply Voltage (quiet)
Quiet supply voltage to the input buffers of each I/O bank. x is the bank number. Within the
package, the VMV plane is decoupled from the simultaneous switching noise originated from the
output buffer VCCI domain. This minimizes the noise transfer within the package and improves
input signal integrity. Each bank must have at least one VMV connection, and no VMV should be
left unconnected. All I/Os in a bank run off the same VMVx supply. VMV is used to provide a quiet
supply voltage to the input buffers of each I/O bank. VMVx can be 1.2 V (ProASIC3L and IGLOO/e
devices only), 1.5 V, 1.8 V, 2.5 V, or 3.3 V, nominal voltage. Unused I/O banks should have their
corresponding VMV pins tied to GND. VMV and VCCI should be at the same voltage within a given
I/O bank. Used VMV pins must be connected to the corresponding VCCI pins of the same bank (i.e.,
VMV0 to VCCIB0, VMV1 to VCCIB1, etc.).
VCCPLA/B/C/D/E/F
PLL Supply Voltage
Supply voltage to analog PLL, nominally 1.5 V or 1.2 V, depending on the device family.
1.5 V for IGLOO V5, IGLOOe V5, ProASIC3, and ProASIC3E devices
1.2 V or 1.5 V for IGLOO V2, IGLOOe V2, ProASIC3L, and ProASIC3EL devices
When the PLLs are not used, the Actel Designer place-and-route tool automatically disables the
unused PLLs to lower power consumption. The user should tie unused VCCPLx and VCOMPLx pins to
ground. Actel recommends tying VCCPLx to VCC and using proper filtering circuits to decouple VCC
noise from PLL. Refer to the PLL Power Supply Decoupling section of Clock Conditioning Circuits in
IGLOO and ProASIC3 Devices for a complete board solution for the PLL analog power supply and
ground.
There is one VCCPLF pin on IGLOO, IGLOO PLUS, ProASIC3L, and ProASIC3 devices.
There are six VCCPLX pins on IGLOOe, ProASIC3EL, and ProASIC3E devices.
相關PDF資料 |
PDF描述 |
|---|---|
| A3P1000-1PQ208PQ208 | FPGA, 1000000 GATES, PQFP208 |
| A3P1000-1PQG208IPQ208 | FPGA, 1000000 GATES, PQFP208 |
| A3P1000-1PQG208PQ208 | FPGA, 1000000 GATES, PQFP208 |
| A3P1000-2FG144FG144 | FPGA, 1000000 GATES, PBGA144 |
| A3P1000-2FG144IFG144 | FPGA, 1000000 GATES, PBGA144 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| A3P1000-1PQ208M | 制造商:Microsemi Corporation 功能描述:FPGA ProASIC?3 Family 1M Gates 130nm Technology 1.5V 208-Pin PQFP 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3 FAMILY 1M GATES 130NM (CMOS) TECHNOLOGY 1.5V 2 - Trays |
| A3P1000-1PQG144 | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1PQG144ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1PQG144I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| A3P1000-1PQG144M | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Military ProASIC3/EL Low-Power Flash FPGAs |
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