- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄352476 > A42MX02-1PQ100B (Electronic Theatre Controls, Inc.) Line Matching Transformer; Current Rating:0A; Insertion Loss:1dB; Leaded Process Compatible:Yes; Peak Reflow Compatible (260 C):Yes; Size:0.89 x 0.812 x 0.715 in; Terminal Type:PCB Thru Hole RoHS Compliant: Yes PDF資料下載
參數(shù)資料
| 型號： | A42MX02-1PQ100B |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Line Matching Transformer; Current Rating:0A; Insertion Loss:1dB; Leaded Process Compatible:Yes; Peak Reflow Compatible (260 C):Yes; Size:0.89 x 0.812 x 0.715 in; Terminal Type:PCB Thru Hole RoHS Compliant: Yes |
| 中文描述： | 40MX和42MX FPGA系列 |
| 文件頁數(shù)： | 46/53頁 |
| 文件大?。?/td> | 854K |
| 代理商： | A42MX02-1PQ100B |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁當(dāng)前第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁
40MX and 42MX FPGA Families
1- 44
v6.0
CMOS Output Module Timing1
tDLH
Data-to-Pad HIGH
3.9
4.5
5.1
6.05
8.5
ns
tDHL
Data-to-Pad LOW
3.4
3.9
4.4
5.2
7.3
ns
tENZH
Enable Pad Z to HIGH
3.4
3.9
4.4
5.2
7.3
ns
tENZL
Enable Pad Z to LOW
4.9
5.6
6.4
7.5
10.5
ns
tENHZ
Enable Pad HIGH to Z
7.9
9.1
10.4
12.2
17.0
ns
tENLZ
Enable Pad LOW to Z
5.9
6.8
7.7
9.0
12.6
ns
dTLH
Delta LOW to HIGH
0.03
0.04
0.05
0.07
ns/pF
dTHL
Delta HIGH to LOW
0.02
0.03
0.04
ns/pF
Table 30
A40MX04 Timing Characteristics (Nominal 5.0V Operation) (Continued)
(Worst-Case Commercial Conditions, VCC = 4.75V, TJ = 70°C)
‘–3’ Speed
‘–2’ Speed
‘–1’ Speed
‘Std’ Speed
‘–F’ Speed
Units
Parameter Description
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Notes:
1. Routing delays are for typical designs across worst-case operating conditions. These parameters should be used for estimating
device performance. Post-route timing analysis or simulation is required to determine actual performance.
2. Set-up times assume fanout of 3. Further testing information can be obtained from the Timer utility.
3. The hold time for the DFME1A macro may be greater than 0 ns. Use the Timer utility from the Designer software to check the hold
time for this macro.
4. Delays based on 35 pF loading.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A42MX04-1PQ100B | TRANSF 600 OHM 100MA DC TEL |
| A42MX09-1PQ100B | TRANSF 600 SPLIT PRI .75MA DC TE |
| A42MX16-1PQ100B | TRANSF 600 OHM 0MA DC TEL |
| A42MX24-1PQ100B | TRANSF 600 OHM 0MA DC TEL |
| A42MX02-1PQ100ES | TRANSF 600 OHM 90MA DC TEL |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| A42MX02-1PQ100ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX02-1PQ100I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX02-1PQ100M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX02-1TQ100 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX02-1TQ100A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。