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參數(shù)資料
| 型號： | A42MX24-3PL84M |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數(shù)： | 53/116頁 |
| 文件大?。?/td> | 3110K |
| 代理商： | A42MX24-3PL84M |
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v5.0
53
40MX and 42MX FPGA Families
A42MX16 Timing Characteristics (Nominal 5.0V Operation)
(continued)
(Worst-Case Commercial Conditions, V
CC
= 4.75V, T
J
= 70
°
C)
‘–
3
’
Speed
‘–
2
’
Speed
‘–
1
’
Speed
‘
Std
’
Speed
‘–
F
’
Speed
Parameter Description
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Units
Input Module Propagation Delays
t
INYH
Pad-to-Y HIGH
1.1
1.2
1.3
1.6
2.2
ns
t
INYL
Pad-to-Y LOW
0.8
0.9
1.0
1.2
1.7
ns
t
INGH
G to Y HIGH
1.4
1.6
1.8
2.1
2.9
ns
t
INGL
Input Module Predicted Routing Delays
1
G to Y LOW
1.4
1.6
1.8
2.1
2.9
ns
t
IRD1
FO=1 Routing Delay
1.8
2.0
2.3
2.7
4.0
ns
t
IRD2
FO=2 Routing Delay
2.1
2.3
2.6
3.1
4.3
ns
t
IRD3
FO=3 Routing Delay
2.3
2.6
3.0
3.5
4.9
ns
t
IRD4
FO=4 Routing Delay
2.6
3.0
3.3
3.9
5.4
ns
t
IRD8
FO=8 Routing Delay
3.6
4.0
4.6
5.4
7.5
ns
Global Clock Network
t
CKH
Input LOW to HIGH
FO = 32
FO = 384
2.6
2.9
2.9
3.2
3.3
3.6
3.9
4.3
5.4
6.0
ns
ns
t
CKL
Input HIGH to LOW
FO = 32
FO = 384
3.8
4.5
4.2
5.0
4.8
5.6
5.6
6.6
7.8
9.2
ns
ns
t
PWH
Minimum Pulse Width
HIGH
FO = 32
FO = 384
3.2
3.7
3.5
4.1
4.0
4.59
4.7
5.4
6.6
7.6
ns
ns
t
PWL
Minimum Pulse Width LOW FO = 32
FO = 384
3.2
3.7
3.5
4.1
4.0
4.6
4.7
5.4
6.6
7.6
ns
ns
t
CKSW
Maximum Skew
FO = 32
FO = 384
0.3
0.3
0.4
0.4
0.4
0.4
0.5
0.5
0.7
0.7
ns
ns
t
SUEXT
Input Latch External Set-Up FO = 32
FO = 384
0.0
0.0
0.0
0.0
0.0
0.0
0.0
0.0
0.0
0.0
ns
ns
t
HEXT
Input Latch External Hold
FO = 32
FO = 384
2.8
3.2
3.1
3.5
5.5
4.0
4.1
4.7
5.7
6.6
ns
ns
t
P
Minimum Period
FO = 32
FO = 384
4.2
4.6
4.67
5.1
5.1
5.6
5.8
6.4
9.7
10.7
ns
ns
f
MAX
Maximum Frequency
FO = 32
FO = 384
237
215
215
195
198
179
172
156
103
94
MHz
MHz
Note:
1.
Routing delays are for typical designs across worst-case operating conditions. These parameters should be used for estimating device
performance. Post-route timing analysis or simulation is required to determine actual performance.
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PDF描述 |
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| A42MX24-3PQ160 | 功能描述:IC FPGA MX SGL CHIP 36K 160-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:MX 產(chǎn)品培訓(xùn)模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產(chǎn)品:Cyclone? IV FPGAs 標(biāo)準(zhǔn)包裝:60 系列:CYCLONE® IV GX LAB/CLB數(shù):9360 邏輯元件/單元數(shù):149760 RAM 位總計:6635520 輸入/輸出數(shù):270 門數(shù):- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FBGA（23x23） |
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