參數(shù)資料
型號(hào)： AD9553BCPZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 30/44頁(yè)
文件大小： 0K
描述： IC INTEGER-N CLCK GEN 32LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： 時(shí)鐘/頻率轉(zhuǎn)換器
PLL： 是
主要目的： 以太網(wǎng)，GPON，SONET/SHD，T1/E1
輸入： CMOS，LVDS，晶體
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 810MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-WFQFN 裸露焊盤(pán)，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP（5x5）
包裝： 托盤(pán)
配用： AD9553/PCBZ-ND - BOARD EVAL FOR AD9553
AD9553
Rev. A | Page 36 of 44
Address
Bit
Bit Name
Description
0x0C
[7:3]
Unused
Unused.
[2:0]
Charge pump clock div.
Enables the PFD clock dividers (used for test only via test mux).
000 = test clocks disabled, normal operation (default).
001 = divide feedback clock by 2.
010 = divide PFD reference input clock by 2.
011 = divide PFD reference input and feedback clocks by 2.
100 = divide pump-up clock by 2.
101 = divide pump-up and feedback clocks by 2.
110 = divide pump-up and PFD reference input clocks by 2.
111 = divide feedback, pump-up, and pump-down clocks by 2.
0x0D
[7:6]
Antibacklash control
Controls the PFD antibacklash period of the PLL. These bits are ineffective unless
Register 0x0B[6] = 1.
00 = minimum (default).
01 = low.
10 = high.
11 = maximum.
[5:1]
Unused
Unused.
0
PLL lock detector power-down
Controls power-down of the PLL lock detector.
0 = lock detector active (default).
1 = lock detector powered down.
VCO Control (Register 0x0E to Register 0x10)
Table 30.
Address
Bit
Bit Name
Description
0x0E
7
Calibrate VCO
Initiates VCO calibration (this is an autoclearing bit). This bit is ineffective unless
Register 0x0E[2] = 1.
6
Enable ALC
Enables automatic level control (ALC) of the VCO.
0 = Register 0x0F[7:2] defines the VCO level.
1 = the device automatically controls the VCO level (default).
[5:3]
ALC threshold
Controls the VCO ALC threshold detector level from minimum (000) to maximum
(111). The default is 110.
2
Enable SPI control of VCO
calibration
Enables the functionality of Register 0x0E[7].
0 = the device automatically performs VCO calibration (default).
1 = VCO calibration controlled by Register 0x0E[7].
1
Boost VCO supply
Selects VCO supply voltage.
0 = normal supply voltage (default).
1 = increase supply voltage by 100 mV.
0
Enable SPI control of VCO band
setting
Controls VCO band setting functionality.
0 = the device automatically selects the VCO band (default).
1 = VCO band defined by Register 0x10[7:1].
0x0F
[7:2]
VCO level control
Controls the VCO amplitude from minimum (00 0000) to maximum (11 1111). These
bits are ineffective unless Register 0x0E[6] = 0.
The default is 10 0000.
[1:0]
Unused
Unused.
0x10
[7:1]
VCO band control
Controls the VCO frequency band from minimum (000 0000) to maximum
(111 1111). These bits are ineffective unless Register 0x0E[0] = 1.
The default is 100 0000.
0
Unused
Unused.
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PDF描述
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參數(shù)描述
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AD9554-1/PCBZ 功能描述:AD9554-1 - Timing, Clock Generator Evaluation Board 制造商:analog devices inc. 系列:- 零件狀態(tài):有效 主要用途:計(jì)時(shí)，時(shí)鐘發(fā)生器 嵌入式:- 使用的 IC/零件:AD9554-1 主要屬性:- 輔助屬性:LED 狀態(tài)指示器 所含物品:板 標(biāo)準(zhǔn)包裝:1
AD9554-1BCPZ 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:托盤(pán) 零件狀態(tài):有效 PLL:是 主要用途:以太網(wǎng)，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：4 差分 - 輸入:輸出:是/是 頻率 - 最大值:942MHz 電壓 - 電源:1.4 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:56-WFQFN 裸焊盤(pán)，CSP 供應(yīng)商器件封裝:56-LFCSP-WQ（8x8） 標(biāo)準(zhǔn)包裝:1
AD9554-1BCPZ-REEL7 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 PLL:是 主要用途:以太網(wǎng)，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：4 差分 - 輸入:輸出:是/是 頻率 - 最大值:942MHz 電壓 - 電源:1.4 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:56-WFQFN 裸焊盤(pán)，CSP 供應(yīng)商器件封裝:56-LFCSP-WQ（8x8） 標(biāo)準(zhǔn)包裝:750
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