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參數(shù)資料
型號(hào): AD9762ARZ
廠商: Analog Devices Inc
文件頁(yè)數(shù): 22/23頁(yè)
文件大?。?/td> 0K
描述: IC DAC 12BIT 125MSPS 28-SOIC
產(chǎn)品培訓(xùn)模塊: Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝: 27
系列: TxDAC®
設(shè)置時(shí)間: 35ns
位數(shù): 12
數(shù)據(jù)接口: 并聯(lián)
轉(zhuǎn)換器數(shù)目: 1
電壓電源: 模擬和數(shù)字
功率耗散(最大): 160mW
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 28-SOIC(0.295",7.50mm 寬)
供應(yīng)商設(shè)備封裝: 28-SOIC W
包裝: 管件
輸出數(shù)目和類型: 2 電流,單極;2 電流,雙極
采樣率(每秒): 125M
產(chǎn)品目錄頁(yè)面: 785 (CN2011-ZH PDF)
AD9762
–8–
REV. B
FREQUENCY – MSPS
dBc
–70
–75
–95
0
20
140
40
60
80
100
120
–80
–85
–90
2ND
HARMONIC
3RD
HARMONIC
4TH
HARMONIC
Figure 12. THD vs. fCLOCK @
fOUT = 2 MHz
1.25
–0.50
–1.25
4000
ERROR
LSB
1000
2000
3000
1.00
–0.25
0.25
0
–0.75
0.50
–1.00
0.75
CODE
0
Figure 15. Typical INL
10dB
Div
0
–100
START: 0.3 MHz
STOP: 50.0 MHz
fCLOCK = 100 MSPS
fOUT = 2.41MHz
SFDR = 72dBc
AMPLITUDE = 0dBFS
Figure 18. Single-Tone SFDR
IOUTFS – mA
SFDR
dBc
80
70
30
28
20
14
60
50
40
75
65
55
45
35
4
6
10
12
16
18
2.5MHz
10MHz
22.2MHz
40MHz
Figure 13. SFDR vs. fOUT and IOUTFS
@ 100 MSPS, 0 dBFS
1
–0.4
4000
ERROR
LSB
1000
2000
3000
0.8
–0.2
0.2
0
0.4
0.6
CODE
0
Figure 16. Typical DNL
10dB
Div
0
–100
START: 0.3 MHz
STOP: 50.0 MHz
fCLOCK = 100 MSPS
fOUT1 = 13.5MHz
fOUT2 = 14.5MHz
SFDR = 62dBc
AMPLITUDE = 0dBFS
Figure 19. Dual-Tone SFDR
OUTPUT FREQUENCY – MHz
SFDR
dBc
75
70
45
1
10
100
60
55
50
65
IDIFF @ –6dBFS
IDIFF @ 0dBFS
IOUTA @ –6dBFS
IOUTA @ 0dBFS
Figure 14. Differential vs. Single-
Ended SFDR vs. fOUT @ 100 MSPS
TEMPERATURE – C
SFDR
dBc
80
75
50
–40
–20
80
60
70
65
60
55
40
20
0
2.5MHz
10MHz
40MHz
Figure 17. SFDR vs. Temperature
@ 100 MSPS, 0 dBFS
10dB
Div
–10
–110
START: 0.3 MHz
STOP: 25.0 MHz
fCLOCK = 50 MSPS
fOUT1 = 6.25MHz
fOUT2 = 6.75MHz
fOUT3 = 7.25MHz
fOUT4 = 7.75MHz
SFDR = 71dBc
AMPLITUDE = 0dBFS
Figure 20. Four-Tone SFDR
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PDF描述
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