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參數(shù)資料
型號： AD9776BSVZ
廠商： Analog Devices Inc
文件頁數(shù)： 37/56頁
文件大?。?/td> 0K
描述： IC DAC 12BIT DUAL 1GSPS 100TQFP
產(chǎn)品培訓(xùn)模塊： DAC Architectures
標(biāo)準(zhǔn)包裝： 1
位數(shù)： 12
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 300mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 100-TQFP-EP（14x14）
包裝： 托盤
輸出數(shù)目和類型： 4 電流，單極
采樣率（每秒）： 1G
AD9776/AD9778/AD9779
Rev. A | Page 42 of 56
05
36
1-
12
0
REFERENCE
CLOCK IN
DATA
CLOCK OUT
INPUT
DATA
tSREFCLK
tHREFCLK
tSDATACLK
tHDATACLK
Figure 92. Timing Specifications, PLL Enabled or Disabled, Interpolation = 1×
REFERENCE
CLOCK IN
DATA
CLOCK OUT
SYNC_IN
tS_SYNC
tH_SYNC
0
536
1-
1
21
INPUT
DATA
tSREFCLK
tHREFCLK
tSDATACLK
tHDATACLK
Figure 93. Timing Specifications, PLL Enabled or Disabled, Interpolation = 2×
0
53
61
-12
2
REFERENCE
CLOCK IN
DATA
CLOCK OUT
INPUT
DATA
tSREFCLK
tHREFCLK
tSDATACLK
tHDATACLK
tS_SYNC
tH_SYNC
SYNC_IN
Figure 94. Timing Specifications, PLL Enabled or Disabled, Interpolation = 4×
REFERENCE
CLOCK IN
DATA
CLOCK OUT
05
36
1-
1
23
INPUT
DATA
tSREFCLK
tHREFCLK
tSDATACLK
tHDATACLK
SYNC_IN
tS_SYNC
tH_SYNC
Figure 95. Timing Specifications, PLL Enabled or Disabled, Interpolation = 8×
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PDF描述
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參數(shù)描述
AD9776BSVZRL 功能描述:IC DAC 12BIT DUAL 1GSPS 100TQFP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:Data Converter Fundamentals DAC Architectures 標(biāo)準(zhǔn)包裝:750 系列:- 設(shè)置時間:7µs 位數(shù):16 數(shù)據(jù)接口:并聯(lián) 轉(zhuǎn)換器數(shù)目:1 電壓電源:雙 ± 功率耗散（最大）:100mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-LCC（J 形引線） 供應(yīng)商設(shè)備封裝:28-PLCC（11.51x11.51） 包裝:帶卷 (TR) 輸出數(shù)目和類型:1 電壓，單極；1 電壓，雙極 采樣率（每秒）:143k
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