VS = +1.8 V, T
參數(shù)資料
型號： ADCLK854BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 16/16頁
文件大?。?/td> 0K
描述： IC CLOCK BUFFER MUX 2:12 48LFCSP
設(shè)計資源： Clock Distribution Circuit with Pin-Programmable Output Frequency, Output Logic Levels, and Fanout (CN0152)
標準包裝： 1
類型： 扇出緩沖器（分配），多路復(fù)用器
電路數(shù)： 1
比率 - 輸入:輸出： 2:12
差分 - 輸入:輸出： 是/是
輸入： CML，CMOS，HSTL，LVDS，LVPECL
輸出： CMOS，LVDS
頻率 - 最大： 1.2GHz
電源電壓： 1.71 V ~ 1.89 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 48-LFCSP
包裝： 托盤
ADCLK854
Rev. 0 | Page 9 of 16
TYPICAL PERFORMANCE CHARACTERISTICS
VS = +1.8 V, TA = 25°C, unless otherwise noted.
CH2 100mV
M 200ps 10.0GS/s
CH1
–36.0mV
2
0
721
8-
0
03
CH2 100mV
M 1.0ns 10.0GS/s
CH1
–36.0mV
2
0
721
8-
0
06
Figure 3. LVDS Output Waveform @ 1200 MHz
Figure 6. LVDS Output Waveform @ 200 MHz
2.3
2.2
2.1
2.0
1.9
1.8
1.7
0.1
1.7
1.5
1.3
1.1
0.9
0.7
0.5
0.3
P
R
O
P
AT
IO
N
DE
L
A
Y
(
n
s)
INPUT DIFFERENTIAL (V p-p)
07
21
8-
004
2.4
2.3
2.2
2.1
2.0
1.9
1.8
1.7
1.6
1.5
1.4
200
1600
1400
1200
1000
800
600
400
P
R
OP
A
GA
T
ION
D
E
L
A
Y
(n
s)
INPUT COMMON-MODE (mV)
07
21
8-
007
Figure 4. LVDS Propagation Delay vs. Input Differential Voltage (VID)
Figure 7. LVDS Propagation Delay vs. VICM
55
45
46
47
48
49
50
51
52
53
54
0
200
400
600
800
1000
1200
DUT
Y
CY
CL
E
(%
)
FREQUENCY (MHz)
07
21
8-
005
715
675
685
695
705
1.62
1.92
1.82
1.72
D
IFF
E
R
E
N
TIA
L
OU
TP
U
T
S
W
IN
G
(m
V
p-p)
POWER SUPPLY (V)
07
21
8-
008
Figure 5. LVDS Output Duty Cycle vs. Frequency
Figure 8. LVDS Differential Output Swing vs. Power Supply Voltage
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PDF描述
ADCLK907BCPZ-WP IC CLK/DATA BUFF DVR 1:1 16LFCSP
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