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參數(shù)資料
| 型號： | ADF4157BCPZ-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 5/24頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL FREQ SYNTH 6GHZ 20LFCSP |
| 標(biāo)準(zhǔn)包裝： | 5,000 |
| 類型： | 分?jǐn)?shù) N 合成器（RF） |
| PLL： | 是 |
| 輸入： | CMOS，TTL |
| 輸出： | 時(shí)鐘 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:1 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 6GHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 2.7 V ~ 3.3 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 20-LFCSP-VQ |
| 包裝： | 帶卷 (TR) |
Data Sheet
ADF4157
Rev. D | Page 13 of 24
LSB FRAC REGISTER (R1) MAP
With R1[2:0] set to 001, the on-chip LSB FRAC register is
programmed as shown in Figure 18.
13-Bit LSB FRAC Value
These 13 bits, along with Bits DB[14:3] in the INT/FRAC
register (R0), control what is loaded as the FRAC value into
the fractional interpolator. This is part of what determines
the overall feedback division factor. It is also used in Equation 1.
These 13 bits are the least significant bits of the 25-bit FRAC
value, and Bits DB[14:3] in the INT/FRAC register are the most
significant bits. See the RF Synthesizer: A Worked Example
section for more information.
Reserved Bits
All reserved bits should be set to 0 for normal operation.
DB31
CONTROL
BITS
RESERVED
13-BIT LSB FRACTIONAL VALUE
(FRAC) (DBB)
RESERVED
DB30 DB29 DB28 DB27 DB26 DB25 DB24 DB23 DB22 DB21 DB20 DB19 DB18 DB17 DB16 DB15 DB14 DB13 DB12 DB11 DB10 DB9
DB8
DB7
DB6
DB5
DB4
DB3
DB2
DB1
DB0
0
F13
F12
F11
F10
F9
F8
F7
F6
F5
F4
F3
F2
F1
0
C3(0) C2(0) C1(1)
F25
F24
..........
F14
F13
LSB FRACTIONAL VALUE
(FRAC)*
0
..........
0
..........
0
1
0
..........
1
0
2
0
..........
1
3
.
..........
.
..........
.
..........
.
1
..........
0
8188
1
..........
0
1
8189
1
..........
1
0
8190
1
..........
1
8191
*THE FRAC VALUE IS MADE UP OF THE 12-BIT MSB STORED IN
REGISTER 0, AND THE 13-BIT LSB REGISTER STORED IN
REGISTER 1. FRAC VALUE = 13-BIT LSB + 12-BIT MSB × 213.
05874-
012
Figure 18. LSB FRAC Register (R1) Map
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