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參數(shù)資料
| 型號： | ADG3304BCBZ-REEL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 20/20頁 |
| 文件大小： | 0K |
| 描述： | IC XLATOR 4CH 1.2/5.5V 12-WLCSP |
| 產(chǎn)品變化通告： | 8mm Carrier Tape Changes 28/Feb/2012 |
| 標準包裝： | 1 |
| 邏輯功能： | 變換器，雙向 |
| 位數(shù)： | 4 |
| 輸入類型： | 邏輯 |
| 輸出類型： | 邏輯 |
| 數(shù)據(jù)速率： | 50Mbps |
| 通道數(shù)： | 4 |
| 輸出/通道數(shù)目： | 1 |
| 差分 - 輸入:輸出： | 無/無 |
| 傳輸延遲（最大）： | 6ns |
| 電源電壓： | 1.15 V ~ 5.5 V |
| 工作溫度： | -25°C ~ 85°C |
| 封裝/外殼： | 12-UFBGA，WLCSP |
| 供應商設備封裝： | 12-WLCSP |
| 包裝： | 標準包裝 |
| 其它名稱： | ADG3304BCBZ-REEL7DKR |
Data Sheet
ADG3304
Rev. D | Page 9 of 20
0
1
2
3
4
5
6
7
8
9
I CCY
(mA)
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
04865-016
TA = 25°C
1 CHANNEL
VCCA = 1.8V
VCCY = 3.3V
30Mbps
20Mbps
10Mbps
5Mbps
50Mbps
Figure 11. ICCY vs. Capacitive Load at Pin Y for A
→Y (1.8 V→3.3 V)
Level Translation
0
0.5
1.0
1.5
2.0
2.5
3.0
3.5
4.0
4.5
5.0
I CCA
(mA)
13
23
33
43
53
CAPACITIVE LOAD (pF)
04860-017
50Mbps
TA = 25°C
1 CHANNEL
VCCA = 1.8V
VCCY = 3.3V
5Mbps
10Mbps
20Mbps
30Mbps
Figure 12. ICCA vs. Capacitive Load at Pin A for Y
→A (3.3 V→1.8 V)
Level Translation
0
2
4
6
8
10
12
I CCY
(mA)
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
04860-020
TA = 25°C
1 CHANNEL
VCCA = 3.3V
VCCY = 5V
50Mbps
30Mbps
20Mbps
10Mbps
5Mbps
Figure 13. ICCY vs. Capacitive Load at Pin Y for A
→Y (3.3 V→5 V)
Level Translation
0
2
4
6
I CCA
(mA)
13
23
33
43
53
CAPACITIVE LOAD (pF)
04860-021
TA = 25°C
1 CHANNEL
VCCA = 3.3V
VCCY = 5V
50Mbps
30Mbps
20Mbps
10Mbps
5Mbps
1
3
5
7
Figure 14. ICCA vs. Capacitive Load at Pin A for Y
→A (5 V→3.3 V)
Level Translation
0
1
2
3
4
5
6
7
8
9
10
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
RISE
TIME
(ns)
TA = 25°C
1 CHANNEL
DATA RATE = 50kbps
VCCA = 1.2V, VCCY = 1.8V
VCCA = 1.8V, VCCY = 3.3V
VCCA = 3.3V, VCCY = 5V
04860-023
Figure 15. Rise Time vs. Capacitive Load at Pin Y (A
→Y Level Translation)
0
0.5
1.0
1.5
2.0
2.5
3.0
3.5
4.0
13
23
33
43
53
63
73
CAPACITIVE LOAD (pF)
FALL
TIME
(ns)
TA = 25°C
1 CHANNEL
DATA RATE = 50kbps
VCCA = 1.8V, VCCY = 3.3V
VCCA = 3.3V, VCCY = 5V
VCCA = 1.2V, VCCY = 1.8V
04860-024
Figure 16. Fall Time vs. Capacitive Load at Pin Y (A
→Y Level Translation)
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