Timing Req" />
參數(shù)資料
型號(hào): ADSP-2101BPZ-100
廠商: Analog Devices Inc
文件頁數(shù): 46/64頁
文件大?。?/td> 0K
描述: IC DSP SLG 16BIT 25MHZ 68-PLCC
標(biāo)準(zhǔn)包裝: 1
系列: ADSP-21xx
類型: 定點(diǎn)
接口: 同步串行端口(SSP)
時(shí)鐘速率: 25MHz
非易失內(nèi)存: 外部
芯片上RAM: 6kB
電壓 - 輸入/輸出: 5.00V
電壓 - 核心: 5.00V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 68-LCC(J 形引線)
供應(yīng)商設(shè)備封裝: 68-PLCC(24.23x24.23)
包裝: 管件
產(chǎn)品目錄頁面: 738 (CN2011-ZH PDF)
ADSP-21xx
–50–
REV. B
TIMING PARAMETERS (ADSP-2103/2162/2164)
SERIAL PORTS
Frequency
10.24 MHz
Dependency
Parameter
Min
Max
Min
Max
Unit
Timing Requirement:
tSCK
SCLK Period
97.6
tCK
ns
tSCS
DR/TFS/RFS Setup before SCLK Low
8
ns
tSCH
DR/TFS/RFS Hold after SCLK Low
10
ns
tSCP
SCLKin Width
28
ns
Switching Characteristic:
tCC
CLKOUT High to SCLKout
24.4
39.4
0.25tCK
0.25tCK + 15
ns
tSCDE
SCLK High to DT Enable
0
ns
tSCDV
SCLK High to DT Valid
28
ns
tRH
TFS/RFSout Hold after SCLK High
0
ns
tRD
TFS/RFSout Delay from SCLK High
28
ns
tSCDH
DT Hold after SCLK High
0
ns
tTDE
TFS (alt) to DT Enable
0
ns
tTDV
TFS (alt) to DT Valid
18
ns
tSCDD
SCLK High to DT Disable
30
ns
tRDV
RFS (Multichannel, Frame Delay Zero)
20
ns
to DT Valid
CLKOUT
SCLK
TFS
RFS
DR
RFSIN
TFSIN
DT
( ALTERNATE
FRAME MODE )
t
CC
t
CC
t
SCK
t
SCP
t
SCP
t
SCS
t
SCH
t
RD
t
RH
RFSOUT
TFSOUT
t
SCDV
t
SCDE
t
SCDH
t
SCDD
t
TDE
t
TDV
t
RDV
( MULTICHANNEL MODE,
FRAME DELAY 0 {MFD = 0} )
Figure 44. Serial Ports
相關(guān)PDF資料
PDF描述
ADSP-BF535PKBZ-300 IC DSP CONTROLLER 16BIT 260 BGA
GCM15DCTN-S288 CONN EDGECARD 30POS .156 EXTEND
V300A36E400BL3 CONVERTER MOD DC/DC 36V 400W
KRM55WR71H226MH01K CAP CER 22UF 50V 20% X7R 2220
VE-B10-CX-B1 CONVERTER MOD DC/DC 5V 75W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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