參數(shù)資料
型號： ADSP-21489BSWZ-4B
廠商： Analog Devices Inc
文件頁數(shù)： 32/68頁
文件大小： 0K
描述： IC CCD SIGNAL PROCESSOR 176LQFP
標準包裝： 1
系列： SHARC®
類型： 浮點
接口： EBI/EMI，DAI，I²C，SPI，SPORT，UART/USART
時鐘速率： 400MHz
非易失內(nèi)存： 外部
芯片上RAM： 5Mb
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.10V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 176-LQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 176-LQFP-EP（24x24）
包裝： 托盤
Rev. B
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March 2013
Table 36. Serial Ports—External Late Frame Sync
Parameter
Min
Max
Unit
Switching Characteristics
tDDTLFSE
1
Data Delay from Late External Transmit Frame Sync or External
Receive Frame Sync with MCE = 1, MFD = 0
8.5
ns
tDDTENFS
1
Data Enable for MCE = 1, MFD = 0
0.5
ns
1 The tDDTLFSE and tDDTENFS parameters apply to left-justified, as well as DSP serial mode, and MCE = 1, MFD = 0.
Figure 22. External Late Frame Sync1
1 This figure reflects changes made to support left-justified mode.
DRIVE
SAMPLE
EXTERNAL RECEIVE FS WITH MCE = 1, MFD = 0
2ND BIT
DAI_P20–1
(SCLK)
DAI_P20–1
(FS)
DAI_P20–1
(DATA CHANNEL
A/B)
1ST BIT
DRIVE
tDDTE/I
tHDTE/I
tDDTLFSE
tDDTENFS
tSFSE/I
DRIVE
SAMPLE
LATE EXTERNAL TRANSMIT FS
2ND BIT
DAI_P20–1
(SCLK)
DAI_P20–1
(FS)
DAI_P20–1
(DATA CHANNEL
A/B)
1ST BIT
DRIVE
tDDTE/I
tHDTE/I
t
tDDTENFS
tSFSE/I
tHFSE/I
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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