參數(shù)資料
型號： ADSP-BF547BBCZ-5A
廠商： Analog Devices Inc
文件頁數(shù)： 45/100頁
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描述： IC DSP 16BIT 533MHZ 400CSBGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類型： 定點
接口： SPI，SSP，TWI，UART，USB
時鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 260kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 400-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 400-CSPBGA（17x17）
包裝： 托盤
配用： ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
DDR SDRAM/Mobile DDR SDRAM Timing
SDRAM/mobile DDR SDRAM read cycle timing.
Table 33. DDR SDRAM/Mobile DDR SDRAM Read Cycle Timing
DDR SDRAM
Mobile DDR SDRAM
Parameter
Min
Max
Min
Max
Unit
Timing Requirements
tAC
Access Window of DQ0-15 to DCK0-1
–1.25
+1.25
0.0
6.00
ns
tDQSCK
Access Window of DQS0-1 to DCK0-1
–1.25
+1.25
0.0
6.00
ns
tDQSQ
DQS0-1 to DQ0-15 Skew, DQS0-1 to Last
DQ0-15 Valid
0.90
0.85
ns
tQH
DQ0-15 to DQS0-1 Hold, DQS0-1 to First
DQ0-15 to Go Invalid
tCK/2 – 1.25
1
tCK/2 – 1.75
2
tCK/2 – 1.25
ns
tRPRE
DQS0-1 Read Preamble
0.9
1.1
0.9
1.1
tCK
tRPST
DQS0-1 Read Postamble
0.4
0.6
0.4
0.6
tCK
1 For 7.50 ns
≤ t
CK < 10 ns.
2 For tCK ≥ 10 ns.
Figure 18. DDR SDRAM Controller Read Cycle Timing
Figure 19. Mobile DDR SDRAM Controller Read Cycle Timing
DCK0-1
DQS0-1
tDQSCK
tAC
tRPRE
tDQSQ
tQH
tRPST
DQ0-15
Dn
Dn+1
Dn+2
Dn+3
DCK0-1
DQS0-1
tDQSCK
tAC
tDQSQ
DQ0-15
Dn
Dn+1
Dn+2
Dn+3
tRPRE
tRPST
tQH
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ADSP-BF547YBC-4A 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 400MHz Blackfin Embedded Processor RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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