參數(shù)資料
型號(hào)： ADSP-BF547BBCZ-5A
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 82/100頁(yè)
文件大?。?/td> 0K
描述： IC DSP 16BIT 533MHZ 400CSBGA
產(chǎn)品培訓(xùn)模塊： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
標(biāo)準(zhǔn)包裝： 1
系列： Blackfin®
類(lèi)型： 定點(diǎn)
接口： SPI，SSP，TWI，UART，USB
時(shí)鐘速率： 533MHz
非易失內(nèi)存： 外部
芯片上RAM： 260kB
電壓 - 輸入/輸出： 2.50V，3.30V
電壓 - 核心： 1.25V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 400-LFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 400-CSPBGA（17x17）
包裝： 托盤(pán)
配用： ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
Rev. C
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February 2010
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
ATAPI Ultra DMA Data-Out Transfer Timing
Table 61 and Figure 56 through Figure 59 describes the ATAPI
ultra DMA data-out transfer timing.
Table 61. ATAPI Ultra DMA Data-Out Transfer Timing
ATAPI Parameter
ATAPI_ULTRA_TIM_x Timing
Register Setting1
Timing Equation
tCYC
2
Cycle time
TDVS, TCYC_TDVS
(TDVS + TCYC_TDVS)
× t
SCLK
t2CYC
Two cycle time
TDVS, TCYC_TDVS
2
× (TDVS + TCYC_TDVS) × t
SCLK
tDVS
Data valid setup time at sender
TDVS
× t
SCLK – (tSK1 + tSK2)
tDVH
Data valid hold time at sender
TCYC_TDVS
× t
SCLK – (tSK1 + tSK2)
tCVS
CRC word valid setup time at host
TDVS
× t
SCLK – (tSK1 + tSK2)
tCVH
CRC word valid hold time at host
TACK
× t
SCLK – (tSK1 + tSK2)
tDZFS
Time from data output released-to-driving to first
strobe timing
TDVS
× t
SCLK – (tSK1 + tSK2)
tLI
Limited interlock time
N/A
2
× t
BD + 2 × tSCLK + tOD
tMLI
Interlock time with minimum
TMLI
× t
SCLK – (tSK1 + tSK2)
tENV
3
ATAPI_DMACK to ATAPI_DIOR/DIOW
TENV
(TENV
× t
SCLK) +/– (tSK1 + tSK2)
tRFS
Ready to final strobe time
N/A
2
× t
BD + 2 × tSCLK + tOD
tACK
Setup and Hold time for ATAPI_DMACK
TACK
× t
SCLK – (tSK1 + tSK2)
tSS
Time from STROBE edge to assertion of ATAPI_DIOW TSS
TSS
× t
SCLK – (tSK1 + tSK2)
1 ATAPI Timing Register Setting should be programmed with a value that guarantees parameter compliance with the ATA ANSI specification for ATA device mode of operation.
2 ATA/ATAPI-6 compliant functionality with limited speed.
3 This timing equation can be used to calculate both the minimum and maximum t
ENV.
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ADSP-BF547YBC-4A 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC 400MHz Blackfin Embedded Processor RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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