參數(shù)資料
型號： AGL10005-FFGG484I
元件分類： FPGA
英文描述： FPGA, 1000000 GATES, 250 MHz, PBGA484
封裝： 13 X 13 MM, 1 MM PITCH, ROHS COMPLIANT, FBGA-144
文件頁數(shù)： 171/204頁
文件大小： 2800K
代理商： AGL10005-FFGG484I
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IGLOO Low-Power Flash FPGAs with Flash*Freeze Technology
A d v an c ed v0 . 1
2-55
Exiting Flash*Freeze Mode
If the embedded PLL is used, the user design must
allow maximum acquisition time for the PLL to
acquire the lock signal.
Within 0.5 s of deasserting the FF pin, the input
buffer can capture new input values. Within the
next 0.5 s, the output buffers are able to drive
the new output values from the core.
Sleep Mode
Actel IGLOO FPGAs support Sleep mode when device
functionality is not required. In Sleep mode, the FPGA
core voltage supply (VCC) is turned off (either grounded
or floated) while other power supplies are left on,
resulting in the FPGA core being turned off to reduce
power consumption. While the IGLOO device is in Sleep
mode, the rest of the system can still be operating and
driving the input buffers of the IGLOO device. The driven
inputs do not pull up the internal power planes, and the
current draw is limited to minimal leakage current.
Table 2-31 shows the power supply status in Sleep mode.
When the VCC power supply is powered off, the
corresponding power pin can be left floating or
grounded.
Shutdown Mode
For AGL030 devices, Shutdown mode can be used by
turning off all power supplies when the device function
is not needed. Cold-sparing and hot-insertion features
enable these devices to be powered down without
turning off the entire system. When power returns, the
live-at-power-up feature enables operation of the device
after reaching the voltage activation point.
application
note
for
more
information
on
how
to
use
tools
and
system
implementation of the various power modes supported
by IGLOO devices.
Table 2-31 Sleep Mode—Power Supply Requirement for
IGLOO Devices
Power Supplies
IGLOO/e Devices
VCC
Powered off
VCCI = VMV
Powered on
VJTAG
Powered on
VPUMP
Powered on
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PDF描述
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