參數(shù)資料
型號(hào): AGLN030V2-ZFQNG68
元件分類: FPGA
英文描述: FPGA, PQCC68
封裝: 8 X 8 MM, 0.90 HEIGHT, 0.40 MM PITCH, ROHS COMPLIANT, QFN-68
文件頁數(shù): 76/114頁
文件大?。?/td> 3991K
代理商: AGLN030V2-ZFQNG68
IGLOO nano DC and Switching Characteristics
2- 50
Advance v0.2
Output DDR Module
Figure 2-19 Output DDR Timing Model
Table 2-73 Parameter Definitions
Parameter Name
Parameter Definition
Measuring Nodes (from, to)
tDDROCLKQ
Clock-to-Out
B, E
tDDROCLR2Q
Asynchronous Clear-to-Out
C, E
tDDROREMCLR
Clear Removal
C, B
tDDRORECCLR
Clear Recovery
C, B
tDDROSUD1
Data Setup Data_F
A, B
tDDROSUD2
Data Setup Data_R
D, B
tDDROHD1
Data Hold Data_F
A, B
tDDROHD2
Data Hold Data_R
D, B
Data_F
(from core)
CLK
CLKBUF
Out
FF2
INBUF
CLR
DDR_OUT
Output DDR
FF1
0
1
X
A
B
D
E
C
B
OUTBUF
Data_R
(from core)
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PDF描述
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參數(shù)描述
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