ProASICPLUS Flash Family FPGAs v5.9 2-51 Module Delays Sample Macrocell Library " />
參數(shù)資料
型號： APA300-FGG144I
廠商： Microsemi SoC
文件頁數(shù)： 137/178頁
文件大?。?/td> 0K
描述： IC FPGA PROASIC+ 300K 144-FBGA
標準包裝： 160
系列： ProASICPLUS
RAM 位總計： 73728
輸入/輸出數(shù)： 100
門數(shù)： 300000
電源電壓： 2.3 V ~ 2.7 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 144-LBGA
供應商設備封裝： 144-FPBGA（13x13）
ProASICPLUS Flash Family FPGAs
v5.9
2-51
Module Delays
Sample Macrocell Library Listing
Figure 2-26 Module Delays
Table 2-47 Worst-Case Military Conditions1
VDD = 2.3 V, TJ = 70 C, TJ = 70°C, TJ = 125°C for Military/MIL-STD-883
Cell Name
Description
Std.
Max
Min
Units
NAND2
2-Input NAND
0.5
ns
AND2
2-Input AND
0.7
ns
NOR3
3-Input NOR
0.8
ns
MUX2L
2-1 MUX with Active Low Select
0.5
ns
OA21
2-Input OR into a 2-Input AND
0.8
ns
XOR2
2-Input Exclusive OR
0.6
ns
LDL
Active Low Latch (LH/HL)
LH2
0.9
ns
CLK-Q
HL2
0.8
ns
tsetup
0.7
ns
thold
0.1
ns
DFFL
Negative Edge-Triggered D-type Flip-Flop (LH/HL)
CLK-Q
LH2
0.9
ns
HL2
0.8
ns
tsetup
0.6
ns
thold
0.0
ns
Notes:
1. Intrinsic delays have a variable component, coupled to the input slope of the signal. These numbers assume an input slope typical of
local interconnect.
2. LH and HL refer to the Q transitions from Low to High and High to Low, respectively.
A
B
50%
Y
50%
50% 50%
50%
C
50%50%
50%
t
DALH
t
DBLH
t
DAHL
t
DBHL
t
DCHL
t
DCLH
A
B
C
Y
相關PDF資料
PDF描述
APA300-FG144I IC FPGA PROASIC+ 300K 144-FBGA
AGL600V5-FG144I IC FPGA 1KB FLASH 600K 144-FBGA
ACM40DTAH-S189 CONN EDGECARD 80POS R/A .156 SLD
ACM40DTAD-S189 CONN EDGECARD 80POS R/A .156 SLD
M1AGL600V5-FGG144I IC FPGA 1KB FLASH 600K 144-FBGA
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參數(shù)描述
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APA300-FGG256M 制造商:Microsemi Corporation 功能描述:FPGA PROASICPLUS 300K GATES 180MHZ 0.22UM 2.5V 256FBGA - Trays
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