參數(shù)資料
型號： AT89LP428-20MH
廠商： Atmel
文件頁數(shù)： 42/149頁
文件大?。?/td> 0K
描述： MCU 8051 4K FLASH SPI 32VQFN
產(chǎn)品培訓模塊： MCU Product Line Introduction
標準包裝： 490
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 30
程序存儲器容量： 4KB（4K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 512 x 8
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 32-VFQFN 裸露焊盤
包裝： 托盤
136
3654A–MICRO–8/09
AT89LP428/828
Figure 24-15. Shift Register Mode Timing Waveform
24.9
Test Conditions
24.9.1
AC Testing Input/Output Waveform(1)
Note:
1. AC Inputs during testing are driven at V
CC - 0.5V for a logic “1” and 0.45V for a logic “0”. Timing measurements are made at
VIH min. for a logic “1” and VIL max. for a logic “0”.
24.9.2
Float Waveform(1)
Note:
1. For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage occurs. A port pin begins to
float when 100 mV change from the loaded VOH/VOL level occurs.
24.8
Serial Port Timing: Shift Register Mode
The values in this table are valid for V
CC = 2.4V to 5.5V and Load Capacitance = 80 pF.
Symbol
Parameter
Variable Oscillator
Units
Min
Max
tXLXL
Serial Port Clock Cycle Time
2tCLCL -15
s
t
QVXH
Output Data Setup to Clock Rising Edge
t
CLCL -15
ns
tXHQX
Output Data Hold after Clock Rising Edge
tCLCL -15
ns
tXHDX
Input Data Hold after Clock Rising Edge
0
ns
t
XHDV
Input Data Valid to Clock Rising Edge
15
ns
01
2
3
4
5
6
7
Valid
Clock
Write to SBUF
Output Data
Clear RI
Input Data
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PDF描述
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參數(shù)描述
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