參數(shù)資料
型號： C8051F561-IQ
廠商： Silicon Laboratories Inc
文件頁數(shù)： 271/302頁
文件大?。?/td> 0K
描述： IC 8051 MCU 32K FLASH 32-QFP
產(chǎn)品培訓(xùn)模塊： Serial Communication Overview
標(biāo)準(zhǔn)包裝： 250
系列： C8051F56x
核心處理器： 8051
芯體尺寸： 8-位
速度： 50MHz
連通性： SMBus（2 線/I²C），CAN，SPI，UART/USART
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 25
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 2.25K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.25 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 25x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 32-LQFP
包裝： 托盤
配用： 336-1691-ND - KIT DEVELOPMENT FOR C8051F560
其它名稱： 336-1696
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C8051F55x/56x/57x
70
Rev. 1.1
8. Comparators
The C8051F55x/56x/57x devices include two on-chip programmable voltage Comparators. A block dia-
gram of the comparators is shown in Figure 8.1, where “n” is the comparator number (0 or 1). The two
Comparators operate identically except that Comparator0 can also be used a reset source. For input
selection details, refer to SFR Definition 8.5 and SFR Definition 8.6.
Each Comparator offers programmable response time and hysteresis, an analog input multiplexer, and two
outputs that are optionally available at the Port pins: a synchronous “l(fā)atched” output (CP0, CP1), or an
asynchronous “raw” output (CP0A, CP1A). The asynchronous signal is available even when the system
clock is not active. This allows the Comparators to operate and generate an output with the device in
STOP mode. When assigned to a Port pin, the Comparator outputs may be configured as open drain or
push-pull (see Section “19.4. Port I/O Initialization” on page 172). Comparator0 may also be used as a
The Comparator0 inputs are selected in the CPT0MX register (SFR Definition 8.5). The CMX0P1-CMX0P0
bits select the Comparator0 positive input; the CMX0N1-CMX0N0 bits select the Comparator0 negative
input. The Comparator1 inputs are selected in the CPT1MX register (SFR Definition 8.6). The CMX1P1-
CMX1P0 bits select the Comparator1 positive input; the CMX1N1-CMX1N0 bits select the Comparator1
negative input.
Important Note About Comparator Inputs:
The Port pins selected as Comparator inputs should be con-
figured as analog inputs in their associated Port configuration register, and configured to be skipped by the
Crossbar (for details on Port configuration, see Section “19.1. Port I/O Modes of Operation” on page 168).
Figure 8.1. Comparator Functional Block Diagram
VIO
Reset
Decision
Tree
+
-
Crossbar
Q
SET
CLR
D
Q
SET
CLR
D
(SYNCHRONIZER)
GND
CPn +
CPn -
CPTnMD
CP
n
R
IE
CPnFIE
CP
nM
D1
CP
nM
D0
CPn
CPnA
CPn
Interrupt
0
1
0
1
CPnRIF
CPnFIF
0
1
CPnEN
0
1
EA
Comparator
Input Mux
CPTnCN
CP
n
E
N
CPnOU
T
CP
nR
IF
CP
nF
IF
CP
nH
Y
P
1
CP
nH
Y
P
0
CP
nH
Y
N
1
CP
nH
Y
N
0
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PDF描述
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C8051F562-IMR 功能描述:8位微控制器 -MCU 50 MIPS 32 kB 2 kB LIN 2.1 SPI RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時(shí)鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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