參數(shù)資料
型號： C8051F561-IQ
廠商： Silicon Laboratories Inc
文件頁數(shù)： 76/302頁
文件大?。?/td> 0K
描述： IC 8051 MCU 32K FLASH 32-QFP
產(chǎn)品培訓(xùn)模塊： Serial Communication Overview
標(biāo)準(zhǔn)包裝： 250
系列： C8051F56x
核心處理器： 8051
芯體尺寸： 8-位
速度： 50MHz
連通性： SMBus（2 線/I²C），CAN，SPI，UART/USART
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 25
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 2.25K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.25 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 25x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 32-LQFP
包裝： 托盤
配用： 336-1691-ND - KIT DEVELOPMENT FOR C8051F560
其它名稱： 336-1696
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Rev. 1.1
167
C8051F55x/56x/57x
19. Port Input/Output
Digital and analog resources are available through 33 (C8051F568-9 and ‘F570-5), 25 (C8051F550-7) or
18 (C8051F550-7) I/O pins. Port pins P0.0-P4.0 on the C8051F568-9 and ‘F570-5, port pins P0.0-P3.0 on
theC8051F560-7, and port pins P0.0-P2.1 on the C8051F550-7 can be defined as general-purpose I/O
(GPIO), assigned to one of the internal digital resources, or assigned to an analog function as shown in
Figure 19.3. Port pin P4.0 on the C8051F568-9 and ‘F570-5 can be used as GPIO and is shared with the
C2 Interface Data signal (C2D). Similarly, port pin P3.0 is shared with C2D on the C8051F560-7 and port
pin P2.1 on the C8051F550-7. The designer has complete control over which functions are assigned, lim-
ited only by the number of physical I/O pins. This resource assignment flexibility is achieved through the
use of a Priority Crossbar Decoder. Note that the state of a Port I/O pin can always be read in the corre-
sponding Port latch, regardless of the Crossbar settings.
The Crossbar assigns the selected internal digital resources to the I/O pins based on the Priority Decoder
(Figure 19.3 and Figure 19.4). The registers XBR0, XBR1, XBR2 are defined in SFR Definition 19.1 and
SFR Definition 19.2 and are used to select internal digital functions.
The Port I/O cells are configured as either push-pull or open-drain in the Port Output Mode registers
(PnMDOUT, where n = 0,1). Complete Electrical Specifications for Port I/O are given in Table 5.3 on
Figure 19.1. Port I/O Functional Block Diagram
External
Pins
Digital
Crossbar
Priority
Decoder
SPI0
CAN0
UART0
CP0
T0, T1,
/INT0,
/INT1
P1.0
P1.7
P2.0
P2.7
P0.0
P0.7
Highest
Priority
Lowest
Priority
8
CP1
(I
nternal
D
igit
a
l
Signal
s)
SMBus0
P3.0
P3.7
8
PnMDOUT,
PnDMIN Registers
XBR0, XBR1,
XBR2, PnSKIP
P1
I/O
Cells
P3
I/O
Cells
P0
I/O
Cells
P2
I/O
Cells
PCA0
7
LIN0
2
PnMASK
PnMATCH
Registers
/SYSCLK
4
Lowest
Priority
Highest
Priority
Port
Latches
P0
P1
P2
P3
P4
33
(Px.0-Px.7)
P4.0
8
P4
I/O
Cell
2
4
2
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PDF描述
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C8051F562-IM 功能描述:8位微控制器 -MCU 50 MIPS 32 kB 2 kB LIN 2.1 SPI UART RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
C8051F562-IMR 功能描述:8位微控制器 -MCU 50 MIPS 32 kB 2 kB LIN 2.1 SPI RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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