參數(shù)資料
型號: CP80C86-2Z
廠商: Intersil
文件頁數(shù): 20/37頁
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描述: IC CPU 16BIT 5V 8MHZ 40-PDIP
標(biāo)準(zhǔn)包裝: 9
處理器類型: 80C86 16-位
速度: 8MHz
電壓: 4.5 ~ 5.5V
安裝類型: 通孔
封裝/外殼: 40-DIP(0.600",15.24mm)
供應(yīng)商設(shè)備封裝: 40-DIP
包裝: 管件
27
FN2957.3
January 9, 2009
NOTE:
The coprocessor may not drive the busses outside the region shown without risking contention.
FIGURE 9. REQUEST/GRANT SEQUENCE TIMING (MAXIMUM MODE ONLY)
FIGURE 10. HOLD/HOLD ACKNOWLEDGE TIMING (MINIMUM MODE ONLY)
NOTE:
Setup requirements for asynchronous signals only to
guarantee recognition at next CLK.
FIGURE 11. ASYNCHRONOUS SIGNAL RECOGNITION
FIGURE 12. BUS LOCK SIGNAL TIMING (MAXIMUM MODE
ONLY)
Waveforms (Continued)
CLK
TCLGH
RQ/GT
PREVIOUS GRANT
AD15-AD0
RD, LOCK
BHE/S7, A19/S0-A16/S3
S2, S1, S0
TCLCL
ANY
CLK
CYCLE
>0-CLK
CYCLES
PULSE 2
80C86
TGVCH (14)
TCHGX (15)
TCLGH (44)
PULSE 1
COPROCESSOR
RQ
TCLAZ (25)
80C86 GT
PULSE 3
COPROCESSOR
RELEASE
(SEE NOTE)
TCHSZ (26)
(1)
TCLGL
(43)
COPROCESSOR
TCHSV (21)
(44)
CLK
HOLD
HLDA
AD15-AD0
BHE/S7, A19/S6-A16/S3
RD, WR, M/IO, DT/R, DEN
80C86
THVCH (13)
TCLHAV (36)
≥ 1CLK
1 OR 2
CYCLES
TCLAZ (19)
COPROCESSOR
80C86
TCLHAV (36)
CYCLE
TCHSZ (20)
THVCH (13)
TCHSV (21)
NMI
INTR
TEST
CLK
SIGNAL
TINVCH (SEE NOTE)
(13)
ANY CLK CYCLE
CLK
LOCK
TCLAV
ANY CLK CYCLE
(23)
TCLAV
(23)
80C86
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PDF描述
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CP80C88R2489 制造商:Rochester Electronics LLC 功能描述:- Bulk