參數(shù)資料
型號： CP80C86-2Z
廠商： Intersil
文件頁數(shù)： 26/37頁
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描述： IC CPU 16BIT 5V 8MHZ 40-PDIP
標準包裝： 9
處理器類型： 80C86 16-位
速度： 8MHz
電壓： 4.5 ~ 5.5V
安裝類型： 通孔
封裝/外殼： 40-DIP（0.600"，15.24mm）
供應商設備封裝： 40-DIP
包裝： 管件
32
FN2957.3
January 9, 2009
ADC = Add with Carry:
Register/Memory with Register to Either
0 0 0 1 0 0 d w
mod reg r/m
Immediate to Register/Memory
1 0 0 0 0 0 s w
mod 0 1 0 r/m
data
data if s:w = 01
Immediate to Accumulator
0 0 0 1 0 1 0 w
data
data if w = 1
INC = Increment:
Register/Memory
1 1 1 1 1 1 1 w
mod 0 0 0 r/m
Register
0 1 0 0 0 reg
AAA = ASCll Adjust for Add
0 0 1 1 0 1 1 1
DAA = Decimal Adjust for Add
0 0 1 0 0 1 1 1
SUB = Subtract:
Register/Memory and Register to Either
0 0 1 0 1 0 d w
mod reg r/m
Immediate from Register/Memory
1 0 0 0 0 0 s w
mod 1 0 1 r/m
data
data if s:w = 01
Immediate from Accumulator
0 0 1 0 1 1 0 w
data
data if w = 1
SBB = Subtract with Borrow
Register/Memory and Register to Either
0 0 0 1 1 0 d w
mod reg r/m
Immediate from Register/Memory
1 0 0 0 0 0 s w
mod 0 1 1 r/m
data
data if s:w = 01
Immediate from Accumulator
0 0 0 1 1 1 0 w
data
data if w = 1
DEC = Decrement:
Register/Memory
1 1 1 1 1 1 1 w
mod 0 0 1 r/m
Register
0 1 0 0 1 reg
NEG = Change Sign
1 1 1 1 0 1 1 w
mod 0 1 1 r/m
CMP = Compare:
Register/Memory and Register
0 0 1 1 1 0 d w
mod reg r/m
Immediate with Register/Memory
1 0 0 0 0 0 s w
mod 1 1 1 r/m
data
data if s:w = 01
Immediate with Accumulator
0 0 1 1 1 1 0 w
data
data if w = 1
AAS = ASCll Adjust for Subtract
0 0 1 1 1 1 1 1
DAS = Decimal Adjust for Subtract
0 0 1 0 1 1 1 1
MUL = Multiply (Unsigned)
1 1 1 1 0 1 1 w
mod 1 0 0 r/m
IMUL = Integer Multiply (Signed)
1 1 1 1 0 1 1 w
mod 1 0 1 r/m
AAM = ASCll Adjust for Multiply
1 1 0 1 0 1 0 0
0 0 0 0 1 0 1 0
DlV = Divide (Unsigned)
1 1 1 1 0 1 1 w
mod 1 1 0 r/m
IDlV = Integer Divide (Signed)
1 1 1 1 0 1 1 w
mod 1 1 1 r/m
AAD = ASClI Adjust for Divide
1 1 0 1 0 1 0 1
0 0 0 0 1 0 1 0
CBW = Convert Byte to Word
1 0 0 1 1 0 0 0
CWD = Convert Word to Double Word
1 0 0 1 1 0 0 1
LOGIC
NOT = Invert
1 1 1 1 0 1 1 w
mod 0 1 0 r/m
SHL/SAL = Shift Logical/Arithmetic Left
1 1 0 1 0 0 v w
mod 1 0 0 r/m
SHR = Shift Logical Right
1 1 0 1 0 0 v w
mod 1 0 1 r/m
Instruction Set Summary (Continued)
MNEMONIC AND DESCRIPTION
INSTRUCTION CODE
7 6 5 4 3 2 1 0
80C86
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PDF描述
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