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參數(shù)資料
| 型號： | CY38050V484-83BBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 15 ns, PBGA484 |
| 封裝： | 1 MM PITCH, FBGA-484 |
| 文件頁數(shù)： | 16/45頁 |
| 文件大?。?/td> | 720K |
| 代理商： | CY38050V484-83BBC |
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Quantum38K ISR
CPLD Family
Document #: 38-03043 Rev. *G
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Switching Waveforms (continued)
CLOCK
An
Bn–1
Bn+1
tCHMBDV
An–1
tCHMBDV
tCHMS
ADDRESS B
ADDRESS
Dual-Port Synchronous Address Match Busy Signal
ADDRESS A
MATCH
Pin Count
208 = 208 Leads
256 = 256 Balls
484 = 484 Balls
C Y 3 8 1 0 0 V 4 8 4 - 125 B B C
Cypress Semiconductor ID
Family Type
38 = Quantum38K Family
Gate Density
30=30k Usable Gates
50=50k Usable Gates
100=100k Usable Gates
Speed
125 = 125 MHz
83 = 83 MHz
Package Type
N
= Plastic Quad Flat Pack (PQFP)
NT = Thermally Enhanced Quad Flat Pack (EQFP
BB = Fine-Pitch Ball Grid Array (FBGA)
1.0-mm Lead Pitch
Operating Conditions
Commercial
0°C to +70°C
Industrial
-40°C to +85°C
Operating Reference Voltage
V = 3.3V or 2.5V Supply Voltage
相關PDF資料 |
PDF描述 |
|---|---|
| CY38050V208-125NC | LOADABLE PLD, 10 ns, PQFP208 |
| CY38050V208-125NI | LOADABLE PLD, 10 ns, PQFP208 |
| CY38050V256-125BBC | LOADABLE PLD, 10 ns, PBGA256 |
| CY38050V256-125BBI | LOADABLE PLD, 10 ns, PBGA256 |
| CY38050V484-125BBC | LOADABLE PLD, 10 ns, PBGA484 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| CY38100V208-125NTI | 制造商:Cypress Semiconductor 功能描述:CPLD QUANTUM38K 144K GATES 1536 MCRCLLS IND 0.18UM 2.5V/3.3V - Bulk |
| CY3858-000 | 制造商:TE Connectivity 功能描述:2524F0524-1L/9-9-L016 - Cable Rools/Shrink Tubing |
| CY39 | 制造商:PLETRONICS 制造商全稱:Pletronics, Inc. 功能描述:Crystals |
| CY3900I | 功能描述:開發(fā)軟件 ISR Programming Kit RoHS:否 制造商:Atollic Inc. 產(chǎn)品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| CY3900I_05 | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:Delta39K⑩⁄Ultra37000⑩ ISR⑩ Programming Kits |
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