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參數(shù)資料
| 型號： | CY39200V676-167MBC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | LOADABLE PLD, 8.5 ns, PBGA676 |
| 封裝： | 27 X 27 MM, 1.60 MM HEIGHT, 1 MM PITCH, FBGA-676 |
| 文件頁數(shù)： | 17/57頁 |
| 文件大?。?/td> | 1166K |
| 代理商： | CY39200V676-167MBC |
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PRELIMINARY
Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. **
Page 24 of 57
fPLLO
[13]
6.2
266
6.2
266
6.2
266
6.2
266
6.2
266
6.2
266
6.2
200
6.2
200
MHz
fPLLI
[13]
25
133
25
133
25
133
25
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25
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25
133
25
100
25
100
MHz
JTAG Parameters
tJCKH
25
ns
tJCKL
25
ns
tJCP
50
ns
tJSU
10
ns
tJH
10
ns
tJCO
20
ns
tJXZ
20
ns
tJZX
20
ns
Note:
13. Refer to page 11 and the application note titled “Delta39K PLL and Clock Tree” for details on the PLL operation & specification
Switching Characteristics - Parameter Values Over the Operating Range (continued)
Parameter
250
222
200
181
167
154
125
83
Min. Max. Min. Max. Min. Max. Min. Max. Min. Max. Min. Max. Min. Max. Min. Max.
Unit
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CY39200Z208-167NC | LOADABLE PLD, 8.5 ns, PQFP208 |
| CY39200Z388-167MGC | LOADABLE PLD, 8.5 ns, PBGA388 |
| CY39200Z484-167BBC | LOADABLE PLD, 8.5 ns, PBGA484 |
| CY39200Z676-167MBC | LOADABLE PLD, 8.5 ns, PBGA676 |
| CY39100V388B-125MGXC | LOADABLE PLD, 10 ns, PBGA388 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CY39200V676-181MBC | 制造商:Cypress Semiconductor 功能描述: |
| CY39200V676-181MBXC | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 Delta39K 200K 181MHz COM RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| CY39200V676-83MBXC | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 Delta39K 200K 83MHz COM RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| CY39200Z208-125BBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200Z208-125BBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
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