FPGA構(gòu)成3/3相雙繞組感應(yīng)發(fā)電機(jī)勵(lì)磁控制系統(tǒng)
一種用VHDL語(yǔ)言實(shí)現(xiàn)的幀同步算法
基于CPLD的接收機(jī)DAGC電路實(shí)現(xiàn)
可編程ASIC器件主從式下載開發(fā)系統(tǒng)的設(shè)計(jì)
基于FPGA的SDRAM控制器設(shè)計(jì)
新型數(shù)字化可編程頻率合成器DDS
基于CPLD的線陣CCD數(shù)據(jù)采集系統(tǒng)的開發(fā)
JTAG口及其對(duì)F1aSh的在線編程
基于FPGA的HMAC_SHA1_96算法設(shè)計(jì)與實(shí)現(xiàn)
CPLD為控制核心16位高精度數(shù)字電壓表設(shè)計(jì)
基于Altera FPGA的軟硬件協(xié)同仿真
基于EIP的配電自動(dòng)化解決方案
CPLD在高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用
基于FPGA的一種高速圖形幀存設(shè)計(jì)
基于FPGA的直接數(shù)字頻率合成器的設(shè)計(jì)/實(shí)現(xiàn)
利用DSP和CPLD增加數(shù)據(jù)采集的可擴(kuò)展性
基于FPGA的快速并行FFT及其在空間太陽(yáng)望遠(yuǎn)鏡圖像鎖定系統(tǒng)中的應(yīng)用
基于CPLD芯片EPM7128設(shè)計(jì)數(shù)據(jù)合并轉(zhuǎn)換器
基于CPLD的串并轉(zhuǎn)換和高速USB通信設(shè)計(jì)
采取前端和后端協(xié)作方案的IC設(shè)計(jì)
基于FPGA的全數(shù)字鎖相環(huán)路的設(shè)計(jì)
光功率計(jì)自動(dòng)測(cè)試系統(tǒng)設(shè)計(jì)
CPLD在信號(hào)濾波和抗干擾中的應(yīng)用
基于CPLD器件的單穩(wěn)態(tài)脈沖展寬電路
水質(zhì)自動(dòng)監(jiān)控系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
介質(zhì)損耗因數(shù)的自動(dòng)數(shù)字測(cè)量系統(tǒng)
基于CPLD的開放式四軸運(yùn)動(dòng)控制器的設(shè)計(jì)
VHDL語(yǔ)言中信號(hào)設(shè)置的不同方式及注意事項(xiàng)
采用PLD快速低成本地設(shè)計(jì)SONET
用FPGA設(shè)計(jì)MP3個(gè)人數(shù)字播放機(jī)
VHDL設(shè)計(jì)中電路簡(jiǎn)化問題的探討
基于VHDL的交通燈控制器設(shè)計(jì)
基于GSM網(wǎng)絡(luò)的遠(yuǎn)程自動(dòng)抄表系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)
Blackfin處理器能夠?qū)崿F(xiàn)高級(jí)RFID閱讀器應(yīng)用
基于CPLD的數(shù)字濾波抗干擾電路設(shè)計(jì)
基于CPLD的聲發(fā)射信號(hào)傳輸系統(tǒng)設(shè)計(jì)
基于FPGA的可編程定時(shí)器/計(jì)數(shù)器8253的設(shè)計(jì)與實(shí)現(xiàn)
用PLD實(shí)現(xiàn)相位精確測(cè)量的研究
CPLD在合成孔徑雷達(dá)目標(biāo)模擬視頻板設(shè)計(jì)中的應(yīng)用
用FPGA技術(shù)實(shí)現(xiàn)某新型通信設(shè)備中PCM碼流處理
一種基于FPGA的直接序列擴(kuò)頻基帶處理器
企業(yè)信息自動(dòng)化的解決方案與策略
基于FPGA的高速數(shù)字鎖相環(huán)的設(shè)計(jì)與實(shí)現(xiàn)
用CPLD實(shí)現(xiàn)Gollmann密鑰流發(fā)生器
Cypress提升Warp&reg工具的運(yùn)行時(shí)間和支持能...; CPLD開發(fā)
Altera為Nois II處理器提供C語(yǔ)言硬件加速工具
Altera視頻圖像應(yīng)用FPGA方案
QuickLogic 推出QuickWorks v9.8
Cadence 推出業(yè)界新型的EDA產(chǎn)品
Tensilica EDA和IC設(shè)計(jì)方法學(xué)參考書
買賣網(wǎng)電子技術(shù)資料、開發(fā)技術(shù)
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