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參數(shù)資料
| 型號： | DS21354LN |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 104/124頁 |
| 文件大小： | 0K |
| 描述： | IC TXRX E1 1-CHIP 3.3V 100-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS |
| 產(chǎn)品變化通告： | Product Discontinuation 20/Feb/2012 |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 功能： | 單芯片收發(fā)器 |
| 接口： | E1，HDLC |
| 電路數(shù)： | 1 |
| 電源電壓： | 3.14 V ~ 3.47 V |
| 電流 - 電源： | 75mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 包括： | 遠(yuǎn)程和 AIS 警報(bào)檢測器 / 發(fā)生器 |
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DS21354/DS21554 3.3V/5V E1 Single-Chip Transceivers
80 of 124
15.
LINE INTERFACE FUNCTIONS
The line interface function in the DS21354/DS21554 contains three sections: (1) the receiver, which
handles clock and data recovery; (2) the transmitter, which waveshapes and drives the E1 line; and (3) the
jitter attenuator. Each of these three sections is controlled by The Line Interface Control Register (LICR)
contrlls each of these three sections.
LICR: LINE INTERFACE CONTROL REGISTER (Address = 18 Hex)
(MSB)
(LSB)
L2
L1
L0
EGL
JAS
JABDS
DJA
TPD
SYMBOL
POSITION
NAME AND DESCRIPTION
L2
LICR.7
Line Build-Out Select Bit 2. Sets the transmitter build out (see Table 15-1
and Table 15-2).
L1
LICR.6
Line Build-Out Select Bit 1. Sets the transmitter build out (see Table 15-1
and Table 15-2).
L0
LICR.5
Line Build-Out Select Bit 0. Sets the transmitter build out (see Table 15-1
and Table 15-2).
EGL
LICR.4
Receive Equalizer Gain Limit.
0 = -12dB
1 = -43dB
JAS
LICR.3
Jitter Attenuator Select.
0 = place the jitter attenuator on the receive side
1 = place the jitter attenuator on the transmit side
JABDS
LICR.2
Jitter Attenuator Buffer Depth Select.
0 = 128 bits
1 = 32 bits (use for delay sensitive applications)
DJA
LICR.1
Disable Jitter Attenuator.
0 = jitter attenuator enabled
1 = jitter attenuator disabled
TPD
LICR.0
Transmit Power Down.
0 = normal transmitter operation
1 = powers down the transmitter and tri-states the TTIP and TRING pins
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PDF描述 |
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