參數(shù)資料
型號： DS21FT42N
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA300
封裝： 27 X 27 MM, BGA-300
文件頁數(shù)： 3/115頁
文件大?。?/td> 534K
代理商： DS21FT42N
DS21FF42/DS21FT42
100 of 115
TRANSMIT SIDE 1.544 MHz BOUNDARY TIMING
(with elastic store enabled) Figure 24-11
TRANSMIT SIDE 2.048 MHz BOUNDARY TIMING
(with elastic store enabled) Figure 24-12
TSER
LSB
MSB
F
MSB
CHANNEL 23
CHANNEL 24
LSB
CHANNEL 1
TCHCLK
TCHBLK
TSYSCLK
TSSYNC
1
Notes:
1. TCHBLK is programmed to block channel 24 (if the TPCSI bit is set, then the signaling data at
TSIG will be ignored during channel 24).
TSIG
A
CHANNEL 23
CHANNEL 24
D/B
CHANNEL 1
C/A
B
A
BC/A
D/B
TSER
LSB
MSB
LSB
CHANNEL 1
TCHCLK
TCHBLK
TSYSCLK
TSSYNC
CHANNEL 31
CHANNEL 32
1
Notes:
1. TSER data in channels 1, 5, 9, 13, 17, 21, 25, and 29 is ignored
2. TCHBLK is programmed to block channel 31 (if the TPCSI bit is set, then the signaling data at TSIG
will be ignored).
3. TCHBLK is forced to one in the same channels as TSER is ignored (see Note 1)
4. The F-bit position (MSB position of channel 1) for the T1 frame is sampled and passed through the
transmit side elastic store (normally the transmit side formatter overwrites the F-bit position unless the
formatter is programmed to pass-through the F-bit position)
TSIG
D/B
CHANNEL 1
CHANNEL 31
CHANNEL 32
C/D
B
A
C/A
B
A
2,3
F4
相關(guān)PDF資料
PDF描述
DS21FF42 DATACOM, FRAMER, PBGA300
DS21FF42N DATACOM, FRAMER, PBGA300
DS21FT44N DATACOM, FRAMER, PBGA300
DS21FT44 DATACOM, FRAMER, PBGA300
DS21Q352 DATACOM, PCM TRANSCEIVER, PBGA256
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參數(shù)描述
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