參數(shù)資料
型號： DS26522GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 218/258頁
文件大小： 0K
描述： IC TXRX T1/E1/J1 DUAL 144CSBGA
產(chǎn)品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 160
類型： 收發(fā)器
驅(qū)動器/接收器數(shù)： 2/2
規(guī)程： RS232
電源電壓： 3.14 V ~ 3.47 V
安裝類型： 表面貼裝
封裝/外殼： 144-BGA，CSPBGA
供應商設備封裝： 144-TECSBGA（13x13）
包裝： 托盤
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁當前第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁
DS26522 Dual T1/E1/J1 Transceiver
62 of 258
8.10
HDLC Controllers
8.10.1 Receive HDLC Controller
The DS26522 has an enhanced HDLC controller that can be mapped into a single time slot, or Sa4 to Sa8 bits (E1
mode), or the FDL (T1 mode). The HDLC controller has a 64-byte FIFO buffer in both the transmit and receive
paths. The user can select any specific bits within the time slot(s) to assign to the HDLC controller, as well as
specific Sa bits (E1 mode).
The HDLC controller performs all the necessary overhead for generating and receiving performance report
messages (PRMs) as described in ANSI T1.403 and the messages as described in AT&T TR54016. The HDLC
controller automatically generates and detects flags, generates and checks the CRC check sum, generates and
detects abort sequences, stuffs and destuffs zeros, and byte aligns to the data stream. The 64-byte buffers in the
HDLC controller are large enough to allow a full PRM to be received or transmitted without host intervention.
Table 8-28 shows the registers related to the HDLC.
Table 8-28. Registers Related to the HDLC
REGISTER
FRAMER
ADDRESSES
FUNCTION
Receive HDLC Control Register (RHC)
010h
Mapping of the HDLC to DS0 or FDL.
Receive HDLC Bit Suppress Register
011h
Receive HDLC bit suppression register.
Receive HDLC FIFO Control Register
087h
Determines the length of the receive HDLC
FIFO.
Receive HDLC Packet Bytes Available
Register (RHPBA)
0B5h
Tells the user how many bytes are available in
the teceive HDLC FIFO.
Receive HDLC FIFO Register (RHF)
0B6h
The actual FIFDO data.
Receive Real-Time Status Register 5
0B4h
Indicates the FIFO status.
Receive Latched Status Register 5 (RLS5)
094h
Latched status.
Receive Interrupt Mask Register 5 (RIM5)
0A4h
Interrupt mask for interrupt generation for the
latched status.
Transmit HDLC Control Register 1(THC1)
110h, 310h
Miscellaneous transmit HDLC control.
Transmit HDLC Bit Suppress Register
111h, 311h
Transmit HDLC bit suppress for bits not to be
used.
Transmit HDLC Control Register 2 (THC2)
113h, 313h
HDLC to DS0 channel selection and other
control.
Transmit HDLC FIFO Control Register
187h
Used to control the transmit HDLC FIFO.
Transmit Real-Time Status Register 2
1B1h
Indicates the real-time status of the transmit
HDLC FIFO.
Transmit HDLC Latched Status Register 2
191h
Indicates the FIFO status.
Transmit Interrupt Mask Register 2 (HDLC)
Register (TIM2)
1A1h
Interrupt mask for the latched status.
Transmit HDLC FIFO Buffer Available
Register (TFBA)
1B3h
Indicates the number of bytes that can be
written into the transmit FIFO.
Transmit HDLC FIFO Register (THF)
1B4h
Transmit HDLC FIFO.
Note: The addresses shown are for Framer 1. The address for Framer 2 can be calculated by adding 200 hex to the framer address.
相關PDF資料
PDF描述
DS26524GNA5+ IC TXRX T1/E1/J1 QUAD 256-CSBGA
DS26528GNA5+ IC TXRX T1/E1/J1 OCT 256-CSBGA
DS26900LN+ IC JTAG MUX/SWITCH 144-LQFP
DS275E/T&R IC TXRX LINE-PWR RS232 14-TSSOP
DS276S IC TXRX LOW POWER RS-232 8-SOIC
相關代理商/技術參數(shù)
參數(shù)描述
DS26522GN+ 功能描述:網(wǎng)絡控制器與處理器 IC 2-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS26524 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Quad T1/E1/J1 Transceiver
DS26524_07 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Quad T1/E1/J1 Transceiver
DS26524DK 功能描述:網(wǎng)絡開發(fā)工具 DS26524 Dev Kit RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS26524G 功能描述:網(wǎng)絡控制器與處理器 IC 4-Port E1/T1/J1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
發(fā)布緊急采購，3分鐘左右您將得到回復。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*