參數(shù)資料
型號： DS3174
英文描述： Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers
中文描述： 單/雙/三/四路、DS3/E3單芯片收發(fā)器
文件頁數(shù)： 199/232頁
文件大小： 2133K
代理商： DS3174
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DS3171/DS3172/DS3173/DS3174
199 of 232
Register Name:
Register Description:
Register Address:
Bit #
Name
Bit #
Name
E3G832.RSRL1
E3 G.832 Receive Status Register Latched #1
(1,3,5,7)28h
15
14
--
13
TIL
12
11
10
9
8
Reserved
RPTUL
RPTML
RPTL
Reserved
RUA1L
7
6
5
4
3
2
1
0
GCL
NRL
COFAL
LOFL
RDIL
AISL
OOFL
LOSL
Bit 13: Timing Source Indication Change
Latched
(TIL)
– This bit is set when the TI[3:0] bits change state.
Bit 12: Receive Payload Type Unstable
Latched
(RPTUL)
– This bit is set when the RPTU bit transitions from
zero to one.
Bit 11: Receive Payload Type Mismatch
Latched
(RPTML)
– This bit is set when the RPTM bit transitions from
zero to one.
Bit 10: Receive Payload Type Change
Latched
(RPTL)
– This bit is set when the RPT[2:0] bits change state.
Bit 8: Receive Unframed All 1’s Change Latched (RUA1L)
– This bit is set when the RUA1 bit changes state.
Bit 7: GC Byte Change
Latched
(GCL)
– This bit is set when the RGC byte changes state.
Bit 6: NR Byte Change
Latched
(NRL)
– This bit is set when the RNR byte changes state.
Bit 5: Change Of Frame Alignment Latched (COFAL)
– This bit is set when the data path frame counters are
updated with a new frame alignment that is different from the previous frame alignment.
Bit 4: Loss Of Frame Change
Latched
(LOFL)
– This bit is set when the LOF bit changes state.
Bit 3: Remote Defect Indication Change
Latched
(RDIL)
– This bit is set when the RDI bit changes state.
Bit 2: Alarm Indication Signal Change
Latched
(AISL)
– This bit is set when the AIS bit changes state.
Bit 1: Out Of Frame
Change
Latched
(OOFL)
– This bit is set when the OOF bit changes state.
Bit 0: Loss Of Signal Change
Latched
(LOSL)
– This bit is set when the LOS bit changes state.
Register Name:
Register Description:
Register Address:
Bit #
Name
Bit #
Name
E3G832.RSRL2
E3 G.832 Receive Status Register Latched #2
(1,3,5,7)2Ah
15
--
14
--
13
--
12
--
11
10
9
8
Reserved
FBEL
PEL
FEL
7
--
6
--
5
--
4
--
3
2
1
0
Reserved
FBECL
PECL
FECL
Bit 10: Remote Error Indication Latched (FBEL)
– This bit is set when a remote error indication is detected.
Bit 9: Parity Error Latched (PEL)
– This bit is set when a BIP-8 parity error is detected.
Bit 8: Framing Error Latched (FEL)
– This bit is set when a framing error is detected.
Bit 2: Remote Error Indication Count Latched (FBECL)
– This bit is set when the FBEC bit transitions from zero
to one.
Bit 1: Parity Error Count Latched (PECL)
– This bit is set when the PEC bit transitions from zero to one.
Bit 0: Framing Error Count Latched (FECL)
– This bit is set when the FEC bit transitions from zero to one.
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PDF描述
DS3174N Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers
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參數(shù)描述
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DS3174DK 功能描述:網(wǎng)絡(luò)開發(fā)工具 RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS3174N 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3174N+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC Quad DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3177+ 制造商:Maxim Integrated Products 功能描述:IC TXRX DS3/E3 CSBGA
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