(VDD = 3.3V ±5%," />
參數(shù)資料
型號(hào)： DS3254N+
廠商： Maxim Integrated Products
文件頁數(shù)： 51/71頁
文件大小： 0K
描述： IC LIU DS3/E3/STS-1 144-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 160
類型： 線路接口裝置（LIU）
驅(qū)動(dòng)器/接收器數(shù)： 4/4
規(guī)程： IEEE 1149.1
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 144-BGA，CSPBGA
供應(yīng)商設(shè)備封裝： 144-TECSBGA（13x13）
包裝： 托盤
DS3251/DS3252/DS3253/DS3254
55 of 71
Table 17-J. JTAG Interface Timing
(VDD = 3.3V ±5%, TA = -40°C to +85°C.) (Figure 17-6)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
JTCLK Clock Period
t1
1000
ns
JTCLK Clock High/Low Time (Note 1)
t2/t3
50
500
ns
JTCLK to JTDI, JTMS Setup Time
t4
50
ns
JTCLK to JTDI, JTMS Hold Time
t5
50
ns
JTCLK to JTDO Delay
t6
2
50
ns
JTCLK to JTDO High-Z Delay (Note 2)
t7
2
50
ns
JTRST Width Low Time
t8
100
ns
Note 1:
Clock can be stopped high or low.
Note 2:
Not tested during production test.
Figure 17-6. JTAG Timing Diagram
t1
JTDO
t4
t5
t2
t3
t7
JTDI, JTMS, JTRST
t6
JTRST
t8
JTCLK
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PDF描述
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