參數(shù)資料
型號： DS72611RP80FPV
廠商： Renesas Electronics America
文件頁數(shù)： 145/226頁
文件大小： 0K
描述： IC SUPERH MPU ROMLESS 176LQFP
產(chǎn)品培訓模塊： CAN Basics Part-1
CAN Basics Part-2
Electromagnetic Noise Reduction Techniques Part 1
標準包裝： 1
系列： SuperH® SH7200
核心處理器： SH-2A
芯體尺寸： 32-位
速度： 80MHz
連通性： CAN，EBI/EMI，F(xiàn)IFO，I²C，SCI，串行聲控
外圍設備： DMA，POR，PWM，WDT
輸入/輸出數(shù)： 104
程序存儲器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉換器： A/D 8x10b; D/A 2x8b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 176-LQFP
包裝： 托盤
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R01UH0025EJ0300 Rev. 3.00
Page xxv of xxxii
Sep 24, 2010
20.5.3
Slave Reception ................................................................................................ 934
20.5.4
Master Reception .............................................................................................. 935
20.5.5
Slave Transmission ........................................................................................... 936
20.6
Operation Timing.............................................................................................................. 937
20.6.1
Master Transmit Operation ............................................................................... 937
20.6.2
Slave Receive Operation................................................................................... 938
20.6.3
Master Receive Operation................................................................................. 939
20.6.4
Slave Transmit Operation ................................................................................. 940
20.7
Interrupt Sources............................................................................................................... 941
20.8
Usage Notes ...................................................................................................................... 943
20.8.1
Notes when the Communications have not been Completed within the
Maximum Number of Transmit Bytes .............................................................. 943
Section 21 CD-ROM Decoder (ROM-DEC) .....................................................945
21.1
Features............................................................................................................................. 945
21.1.1
Formats Supported by ROM-DEC.................................................................... 946
21.2
Block Diagrams ................................................................................................................ 947
21.3
Register Descriptions ........................................................................................................ 951
21.3.1
ROM-DEC Enable Control Register (CROMEN) ............................................ 954
21.3.2
Sync Code-Based Synchronization Control Register (CROMSY0) ................. 955
21.3.3
Decoding Mode Control Register (CROMCTL0) ............................................ 956
21.3.4
EDC/ECC Check Control Register (CROMCTL1) .......................................... 958
21.3.5
Automatic Decoding Stop Control Register (CROMCTL3)............................. 959
21.3.6
Decoding Option Setting Control Register (CROMCTL4) .............................. 960
21.3.7
HEAD20 to HEAD22 Representation Control Register (CROMCTL5) .......... 961
21.3.8
Sync Code Status Register (CROMST0) .......................................................... 962
21.3.9
Post-ECC Header Error Status Register (CROMST1)...................................... 963
21.3.10
Post-ECC Subheader Error Status Register (CROMST3) ................................ 964
21.3.11
Header/Subheader Validity Check Status Register (CROMST4) ..................... 965
21.3.12
Mode Determination and Link Sector Detection Status Register
(CROMST5) ..................................................................................................... 966
21.3.13
ECC/EDC Error Status Register (CROMST6) ................................................. 967
21.3.14
Buffer Status Register (CBUFST0) .................................................................. 968
21.3.15
Decoding Stoppage Source Status Register (CBUFST1).................................. 969
21.3.16
Buffer Overflow Status Register (CBUFST2) .................................................. 970
21.3.17
Pre-ECC Correction Header: Minutes Data Register (HEAD00) ..................... 970
21.3.18
Pre-ECC Correction Header: Seconds Data Register (HEAD01)..................... 971
21.3.19
Pre-ECC Correction Header: Frames (1/75 Second) Data Register
(HEAD02)......................................................................................................... 971
21.3.20
Pre-ECC Correction Header: Mode Data Register (HEAD03)......................... 971
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