參數(shù)資料
型號(hào)： DS72612RP80FPV
廠商： Renesas Electronics America
文件頁數(shù)： 3/226頁
文件大?。?/td> 0K
描述： IC SUPERH MPU ROMLESS 176LQFP
產(chǎn)品培訓(xùn)模塊： CAN Basics Part-1
CAN Basics Part-2
Electromagnetic Noise Reduction Techniques Part 1
標(biāo)準(zhǔn)包裝： 1
系列： SuperH® SH7200
核心處理器： SH-2A
芯體尺寸： 32-位
速度： 80MHz
連通性： EBI/EMI，F(xiàn)IFO，I²C，IEBus，SCI，串行聲控
外圍設(shè)備： DMA，POR，PWM，WDT
輸入/輸出數(shù)： 104
程序存儲(chǔ)器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b; D/A 2x8b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 176-LQFP
包裝： 托盤
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R01UH0025EJ0300 Rev. 3.00
Page xi of xxxii
Sep 24, 2010
5.2.3
Power-On Reset ................................................................................................ 102
5.2.4
Manual Reset .................................................................................................... 104
5.3
Address Errors .................................................................................................................. 105
5.3.1
Address Error Sources ...................................................................................... 105
5.3.2
Address Error Exception Handling ................................................................... 106
5.4
Bus Error........................................................................................................................... 107
5.4.1
Bus Error Generation Source ............................................................................ 107
5.4.2
Bus Error Exception Handling.......................................................................... 107
5.5
Register Bank Errors......................................................................................................... 108
5.5.1
Register Bank Error Sources............................................................................. 108
5.5.2
Register Bank Error Exception Handling ......................................................... 108
5.6
Interrupts........................................................................................................................... 109
5.6.1
Interrupt Sources............................................................................................... 109
5.6.2
Interrupt Priority Level ..................................................................................... 110
5.6.3
Interrupt Exception Handling............................................................................ 111
5.7
Exceptions Triggered by Instructions ............................................................................... 112
5.7.1
Types of Exceptions Triggered by Instructions ................................................ 112
5.7.2
Trap Instructions ............................................................................................... 113
5.7.3
Slot Illegal Instructions ..................................................................................... 113
5.7.4
General Illegal Instructions............................................................................... 113
5.7.5
Integer Division Exceptions.............................................................................. 114
5.7.6
FPU Exceptions ................................................................................................ 114
5.8
When Exception Sources Are Not Accepted .................................................................... 115
5.9
Stack Status after Exception Handling Ends..................................................................... 116
5.10
Usage Notes ...................................................................................................................... 118
5.10.1
Value of Stack Pointer (SP) .............................................................................. 118
5.10.2
Value of Vector Base Register (VBR) .............................................................. 118
5.10.3
Address Errors Caused by Stacking of Address Error Exception Handling ..... 118
Section 6 Interrupt Controller (INTC) ...............................................................119
6.1
Features............................................................................................................................. 119
6.2
Input/Output Pins .............................................................................................................. 121
6.3
Register Descriptions ........................................................................................................ 121
6.3.1
Interrupt Priority Registers 01, 02, 05 to 16
(IPR01, IPR02, IPR05 to IPR16) ...................................................................... 123
6.3.2
Interrupt Control Register 0 (ICR0).................................................................. 125
6.3.3
Interrupt Control Register 1 (ICR1).................................................................. 126
6.3.4
Interrupt Control Register 2 (ICR2).................................................................. 127
6.3.5
IRQ Interrupt Request Register (IRQRR)......................................................... 127
6.3.6
PINT Interrupt Enable Register (PINTER)....................................................... 129
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PDF描述
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