參數(shù)資料
型號： DSP56321VL200R2
廠商： Freescale Semiconductor
文件頁數(shù)： 68/84頁
文件大?。?/td> 0K
描述： IC DSP 24BIT 200MHZ 196-MAPBGA
標準包裝： 750
系列： DSP56K/Symphony
類型： 定點
接口： 主機接口，SSI，SCI
時鐘速率： 200MHz
非易失內(nèi)存： ROM（576 B）
芯片上RAM： 576kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.60V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 196-FBGA
供應商設備封裝： 196-MAPBGA（15x15）
包裝： 帶卷 (TR)
DSP56321 Technical Data, Rev. 11
A-6
Freescale Semiconductor
Power Consumption Benchmark
M_HOD EQU $8
; Host Request Open Drain mode
M_HDSP EQU $9
; Host Data Strobe Polarity
M_HASP EQU $A
; Host Address Strobe Polarity
M_HMUX EQU $B
; Host Multiplexed bus select
M_HD_HS EQU $C
; Host Double/Single Strobe select
M_HCSP EQU $D
; Host Chip Select Polarity
M_HRP EQU $E
; Host Request Polarity
M_HAP EQU $F
; Host Acknowledge Polarity
;------------------------------------------------------------------------
;
EQUATES for Serial Communications Interface (SCI)
;
;------------------------------------------------------------------------
;
Register Addresses
M_STXH EQU $FFFF97
; SCI Transmit Data Register (high)
M_STXM EQU $FFFF96
; SCI Transmit Data Register (middle)
M_STXL EQU $FFFF95
; SCI Transmit Data Register (low)
M_SRXH EQU $FFFF9A
; SCI Receive Data Register (high)
M_SRXM EQU $FFFF99
; SCI Receive Data Register (middle)
M_SRXL EQU $FFFF98
; SCI Receive Data Register (low)
M_STXA EQU $FFFF94
; SCI Transmit Address Register
M_SCR EQU $FFFF9C
; SCI Control Register
M_SSR EQU $FFFF93
; SCI Status Register
M_SCCR EQU $FFFF9B
; SCI Clock Control Register
;
SCI Control Register Bit Flags
M_WDS EQU $7
; Word Select Mask (WDS0-WDS3)
M_WDS0 EQU 0
; Word Select 0
M_WDS1 EQU 1
; Word Select 1
M_WDS2 EQU 2
; Word Select 2
M_SSFTD EQU 3
; SCI Shift Direction
M_SBK EQU 4
; Send Break
M_WAKE EQU 5
; Wakeup Mode Select
M_RWU EQU 6
; Receiver Wakeup Enable
M_WOMS EQU 7
; Wired-OR Mode Select
M_SCRE EQU 8
; SCI Receiver Enable
M_SCTE EQU 9
; SCI Transmitter Enable
M_ILIE EQU 10
; Idle Line Interrupt Enable
M_SCRIE EQU 11
; SCI Receive Interrupt Enable
M_SCTIE EQU 12
; SCI Transmit Interrupt Enable
M_TMIE EQU 13
; Timer Interrupt Enable
M_TIR EQU 14
; Timer Interrupt Rate
M_SCKP EQU 15
; SCI Clock Polarity
M_REIE EQU 16
; SCI Error Interrupt Enable (REIE)
;
SCI Status Register Bit Flags
M_TRNE EQU 0
; Transmitter Empty
M_TDRE EQU 1
; Transmit Data Register Empty
M_RDRF EQU 2
; Receive Data Register Full
M_IDLE EQU 3
; Idle Line Flag
M_OR EQU 4
; Overrun Error Flag
M_PE EQU 5
; Parity Error
M_FE EQU 6
; Framing Error Flag
M_R8 EQU 7
; Received Bit 8 (R8) Address
;
SCI Clock Control Register
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PDF描述
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TACA336M010RTA CAP TANT 33UF 10V 20% 1206
ECC23DJXN-S1136 CONN EDGECARD 46PS .100 PRESSFIT
VJ1206A271KBBAT4X CAP CER 270PF 100V 10% NP0 1206
GEC15DREN CONN EDGECARD 30POS .100 EYELET
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