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參數(shù)資料
| 型號： | ENC624J600T-I/PT |
| 廠商： | Microchip Technology |
| 文件頁數(shù)： | 7/168頁 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET CTRLR W/SPI 64-TQFP |
| 視頻文件： | Fast 100 Mbps Ethernet PICtail Plus Overview |
| 標(biāo)準(zhǔn)包裝： | 1,200 |
| 控制器類型： | 以太網(wǎng)控制器（IEEE 802.3） |
| 接口： | SPI |
| 電源電壓： | 3 V ~ 3.6 V |
| 電流 - 電源： | 96mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-TQFP |
| 供應(yīng)商設(shè)備封裝： | 64-TQFP（10x10） |
| 包裝： | 帶卷 (TR) |
| 配用： | AC164132-ND - BOARD DAUGHTER PICTAIL ETHERNET |
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PIC18F2220/2320/4220/4320
DS39599G-page 102
2007 Microchip Technology Inc.
FIGURE 10-2:
BLOCK DIAGRAM OF
RA3:RA0 AND RA5 PINS
FIGURE 10-3:
BLOCK DIAGRAM OF
RA6 PIN
FIGURE 10-4:
BLOCK DIAGRAM OF
RA4/T0CKI PIN
FIGURE 10-5:
BLOCK DIAGRAM OF
RA7 PIN
Data
Bus
QD
EN
P
N
WR LATA
WR TRISA
Data Latch
TRIS Latch
RD TRISA
RD PORTA
VSS
VDD
I/O pin(1)
Note 1:
I/O pins have protection diodes to VDD and VSS.
Analog
Input
Mode
TTL
Input
Buffer
To A/D Converter and LVD Modules
RD LATA
or
PORTA
Q
D
Q
CK
Q
D
Q
CK
SS Input (RA5 only)
Data
Bus
Q
D
Q
CK
QD
EN
P
N
WR LATA
WR
Data Latch
TRIS Latch
RD
RD PORTA
VSS
VDD
I/O pin(1)
Note 1:
I/O pins have protection diodes to VDD and VSS.
or
PORTA
RD LATA
RA6 Enable
ECIO or
Enable
TTL
Input
Buffer
RCIO
TRISA
Q
D
Q
CK
TRISA
Data
Bus
WR TRISA
RD PORTA
Data Latch
TRIS Latch
Schmitt
Trigger
Input
Buffer
N
VSS
I/O pin(1)
TMR0 Clock Input
Q
D
Q
CK
Q
D
Q
CK
EN
QD
EN
RD LATA
WR LATA
or
PORTA
Note 1:
I/O pins have protection diodes to VDD and VSS.
RD TRISA
Data
Bus
Q
D
Q
CK
QD
EN
P
N
WR LATA
WR
Data Latch
TRIS Latch
RD
RD PORTA
VSS
VDD
I/O pin(1)
Note 1:
I/O pins have protection diodes to VDD and VSS.
or
PORTA
RD LATA
Enable
TTL
Input
Buffer
RA7
TRISA
Q
D
Q
CK
TRISA
RA7 Enable
To Oscillator
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PDF描述 |
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參數(shù)描述 |
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