參數(shù)資料
型號： EP20K200EFI672-2X
廠商： Altera
文件頁數(shù)： 101/117頁
文件大小： 0K
描述： IC APEX 20KE FPGA 200K 672-FBGA
標準包裝： 40
系列： APEX-20K®
LAB/CLB數(shù)： 832
邏輯元件/單元數(shù)： 8320
RAM 位總計： 106496
輸入/輸出數(shù)： 376
門數(shù)： 404000
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 672-BBGA
供應商設備封裝： 672-BGA（27x27）
84
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Table 52. EP20K30E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
0.55
0.78
1.15
ns
tCL
0.55
0.78
1.15
ns
tCLRP
0.22
0.31
0.46
ns
tPREP
0.22
0.31
0.46
ns
tESBCH
0.55
0.78
1.15
ns
tESBCL
0.55
0.78
1.15
ns
tESBWP
1.43
2.01
2.97
ns
tESBRP
1.15
1.62
2.39
ns
Table 53. EP20K30E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.02
2.13
2.24
ns
tINH
0.00
ns
tOUTC O
2.00
4.88
2.00
5.36
2.00
5.88
ns
tINSUP L L
2.11
2.23
-
ns
tINHPL L
0.00
-
ns
tOUTC OPLL
0.50
2.60
0.50
2.88
-
ns
Table 54. EP20K30E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUB I DIR
1.85
1.77
1.54
ns
tINHBIDIR
0.00
ns
tOUTC OBIDIR
2.00
4.88
2.00
5.36
2.00
5.88
ns
tXZB I DIR
7.48
8.46
9.83
ns
tZXB I DIR
7.48
8.46
9.83
ns
tINSUB I DIRPL L
4.12
4.24
-
ns
tINHBIDIRP L L
0.00
-
ns
tOUTC OBIDIRP L L
0.50
2.60
0.50
2.88
-
ns
tXZB I DIRPL L
5.21
5.99
-
ns
tZXB I DIRPL L
5.21
5.99
-
ns
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