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參數(shù)資料
| 型號： | EP20K300EFC672-2 |
| 廠商： | Altera |
| 文件頁數(shù)： | 112/117頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC APEX 20KE FPGA 300K 672-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 40 |
| 系列： | APEX-20K® |
| LAB/CLB數(shù)： | 1152 |
| 邏輯元件/單元數(shù)： | 11520 |
| RAM 位總計(jì)： | 147456 |
| 輸入/輸出數(shù)： | 408 |
| 門數(shù)： | 728000 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 672-BBGA |
| 供應(yīng)商設(shè)備封裝： | 672-BGA（27x27） |
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94
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K200E APEX 20KE devices.
Table 72. EP20K160E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUB I DIR
2.86
3.24
3.54
ns
tINHBIDIR
0.00
ns
tOUTC OBIDIR
2.00
5.07
2.00
5.59
2.00
6.13
ns
tXZB I DIR
7.43
8.23
8.58
ns
tZXB I DIR
7.43
8.23
8.58
ns
tINSUB I DIRPL L
4.93
5.48
-
ns
tINHBIDIRP L L
0.00
-
ns
tOUTC OBIDIRP L L
0.50
3.00
0.50
3.35
-
ns
tXZB I DIRPL L
5.36
5.99
-
ns
tZXB I DIRPL L
5.36
5.99
-
ns
Table 73. EP20K200E fMAX LE Timing Microparameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tSU
0.23
0.24
0.26
ns
tH
0.23
0.24
0.26
ns
tCO
0.26
0.31
0.36
ns
tLUT
0.70
0.90
1.14
ns
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