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參數資料
型號： EP2SGX30DF780C3N
廠商： Altera
文件頁數： 364/1486頁
文件大?。?/td> 0K
描述： IC STRATIX II GX 30K 780-FBGA
產品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 9
系列： Stratix® II GX
LAB/CLB數： 1694
邏輯元件/單元數： 33880
RAM 位總計： 1369728
輸入/輸出數： 361
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 780-BBGA
供應商設備封裝： 780-FBGA（29x29）
其它名稱： 544-1928
EP2SGX30DF780C3N-ND
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Altera Corporation
13–23
October 2007
Stratix II GX Device Handbook, Volume 2
Configuring Stratix II & Stratix II GX Devices
tDSU
Data setup time before rising edge on DCLK
5
ns
tDH
Data hold time after rising edge on DCLK
0
ns
tCH
DCLK
high time
4
ns
tCL
DCLK
low time
4
ns
tCLK
DCLK
period
10
ns
fMAX
DCLK
frequency
100
MHz
tR
Input rise time
40
ns
tF
Input fall time
40
ns
tCD2UM
CONF_DONE
high to user mode (4)
20
100
s
tCD2CU
CONF_DONE
high to CLKUSR enabled
4
× maximum
DCLK
period
tCD2UMC CONF_DONE high to user mode with
CLKUSR
option on
tCD2CU
+(299 ×
CLKUSR
period)
Notes to Table 13–9:
(1)
This information is preliminary.
(2)
These timing parameters should be used when the decompression and design security feature are not used.
(3)
This value is obtainable if users do not delay configuration by extending the nCONFIG or nSTATUS low pulse
width.
(4)
The minimum and maximum numbers apply only if the internal oscillator is chosen as the clock source for starting
up the device.
Table 13–9. FPP Timing Parameters for Stratix II and Stratix II GX Devices (Part 2 of 2)
Notes (1), (2)
Symbol
Parameter
Min
Max
Units
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PDF描述
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參數描述
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