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參數(shù)資料
| 型號(hào)： | EP4S100G4F45I3N |
| 廠商： | Altera |
| 文件頁(yè)數(shù)： | 7/22頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX IV FPGA 360K 1932FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 3 |
| 系列： | STRATIX® IV GT |
| LAB/CLB數(shù)： | 14144 |
| 邏輯元件/單元數(shù)： | 353600 |
| RAM 位總計(jì)： | 23105536 |
| 輸入/輸出數(shù)： | 781 |
| 電源電壓： | 0.92 V ~ 0.98 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 1932-BBGA |
| 供應(yīng)商設(shè)備封裝： | 1932-FBGA（45x45） |
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1–1
5
Architecture
Features
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Co
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Stra
Volume
Table 1–4 lists the Stratix IV E device features.
Table 1–4. Stratix IV E Device Features
Feature
EP4SE230
EP4SE360
EP4SE530
EP4SE820
Package Pin Count
780
1152
1517
1760
1152
1517
1760
ALMs
91,200
141,440
212,480
325,220
LEs
228,000
353,600
531,200
813,050
High-Speed LVDS
SERDES (up to
1.6 Gbps) (1)
56
88
112
88
112
132
SPI-4.2 Links
3
4
6
4
6
M9K Blocks
(256 x 36 bits)
1,235
1,248
1,280
1610
M144K Blocks
(2048 x 72 bits)
22
48
64
60
Total Memory
(MLAB+M9K+
M144K) Kb
17,133
22,564
27,376
33,294
Embedded Multipliers
(18 x 18) (2)
1,288
1,040
1,024
960
PLLs
4
8
12
8
12
User I/Os (3)
488
744
976
744 (4)
976 (4)
1120 (4)
Speed Grade
(fastest to slowest)
–2, –3, –4
–3, –4
Notes to Table 1–4:
(1) The user I/O count from the pin-out files include all general purpose I/Os, dedicated clock pins, and dual purpose configuration pins. Transceiver pins
and dedicated configuration pins are not included in the pin count.
(2) Four multiplier adder mode.
(3) Total pairs of high-speed LVDS SERDES take the lowest channel count of RX/TX.
(4) This data is preliminary.
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PDF描述 |
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參數(shù)描述 |
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| EP4S100G5F45I2 | 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix IV 21248 LABs 781 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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