參數(shù)資料
型號: EVAL-AD1938AZ
廠商: Analog Devices Inc
文件頁數(shù): 14/32頁
文件大?。?/td> 0K
描述: BOARD EVAL FOR AD1938
標準包裝: 1
主要目的: 音頻編解碼器
已用 IC / 零件: AD1938
主要屬性: 24 位,192 kHz,4 ADC: 107dB 動態(tài)范圍,8 DAC: 108dB 動態(tài)范圍
次要屬性: 分時復用(TDM),SPI 接口
已供物品:
Data Sheet
AD1938
Rev. E | Page 21 of 32
05
58
2-
0
22
ALRCLK
ABCLK
4 ADC CHANNELS OF
SECOND IC IN THE CHAIN
4 ADC CHANNELS OF
FIRST IC IN THE CHAIN
ADC L1 ADC R1 ADC L2 ADC R2 ADC L1 ADC R1 ADC L2 ADC R2
ASDATA1 (TDM_OUT
OF THE SECOND AD193x
IN THE CHAIN)
ADC L1 ADC R1 ADC L2 ADC R2
ASDATA2 (TDM_IN
OF THE SECOND AD193x
IN THE CHAIN)
32 BITS
MSB
DSP
SECOND
AD193x
FIRST
AD193x
Figure 22. ADC TDM Daisy-Chain Mode (512 fS BCLK, Two-AD193x Daisy Chain)
05
582
-0
23
LRCLK
BCLK
SDATA
LRCLK
BCLK
SDATA
LRCLK
BCLK
SDATA
LSB
LEFT CHANNEL
RIGHT CHANNEL
LEFT CHANNEL
RIGHT CHANNEL
MSB
RIGHT-JUSTIFIED MODE—SELECT NUMBER OF BITS PER CHANNEL
DSP MODE—16 BITS TO 24 BITS PER CHANNEL
I2S-JUSTIFIED MODE—16 BITS TO 24 BITS PER CHANNEL
LEFT-JUSTIFIED MODE—16 BITS TO 24 BITS PER CHANNEL
LRCLK
BCLK
SDATA
LSB
NOTES
1. DSP MODE DOES NOT IDENTIFY CHANNEL.
2. LRCLK NORMALLY OPERATES AT
fS EXCEPT FOR DSP MODE WHICH IS 2 × fS.
3. BCLK FREQUENCY IS NORMALLY 64 × LRCLK BUT MAY BE OPERATED IN BURST MODE.
MSB
1/
fS
Figure 23. Stereo Serial Modes
相關PDF資料
PDF描述
V24B12E150BG2 CONVERTER MOD DC/DC 12V 150W
NRS8030T1R5NJGJ INDUCTOR POWER 1.5UH 5.3A SMD
V24B12E150BF3 CONVERTER MOD DC/DC 12V 150W
M1CXA-2636J IDC CABLE - MKC26A/MC26G/X
0982660897 CBL 19POS 0.5MM JMPR TYPE A 1'
相關代理商/技術參數(shù)
參數(shù)描述
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