VDD = V
參數(shù)資料
型號： EVAL-CN0202-SDPZ
廠商： Analog Devices Inc
文件頁數(shù)： 4/24頁
文件大?。?/td> 0K
描述： BOARD CFTL AD5662
設(shè)計資源： CN-0202 CFTL Eval/Design Support
標(biāo)準(zhǔn)包裝： 1
系列： Circuits from the Lab™
主要目的： 參考設(shè)計，模擬輸出模塊
嵌入式： 否
已用 IC / 零件： AD5662，AD5750
已供物品： 板
其它名稱： EVAL-CN0202-SPDZ
EVAL-CN0202-SPDZ-ND
AD5662
Rev. A | Page 12 of 24
04777-010
1
Y AXIS = 2
μV/DIV
X AXIS = 4s/DIV
VDD = VREF = 5V
TA = 25°C
DAC LOADED WITH MIDSCALE
Hz
dB
–20
–50
–80
–30
–40
–60
–70
–90
–100
2k
4k
6k
8k
10k
04777-008
VDD = 5V
TA = 25°C
DAC LOADED WITH FULL SCALE
VREF = 2V ± 0.3Vp-p
Figure 30. 0.1 Hz to 10 Hz Output Noise Plot
Figure 28. Total Harmonic Distortion
CAPACITANCE (nF)
TIME
(
μs)
16
14
12
10
8
6
4
01
2
3
4
5
67
9
81
04777-009
FREQUENCY (Hz)
OU
TPU
T
N
OISE
(
n
V/
√Hz)
800
600
700
400
500
100
200
300
0
10
100k
10k
1k
100
1M
04777-020
VDD = VREF = 5V
TA = 25°C
0
VREF = VDD
TA = 25°C
VDD = 5V
VDD = 3V
Figure 31. Noise Spectral Density
Figure 29. Settling Time vs. Capacitive Load
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PDF描述
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參數(shù)描述
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