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參數(shù)資料
| 型號： | FR65E |
| 廠商： | Fujitsu Limited |
| 英文描述： | 32-Bit Microcontroller |
| 中文描述： | 32位微控制器 |
| 文件頁數(shù)： | 71/87頁 |
| 文件大?。?/td> | 369K |
| 代理商： | FR65E |
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MB91307B
71
(2) Clock Output Timing
(V
CC
=
3.0 V to 3.6 V , V
SS
=
AV
SS
=
0 V, T
A
=
0
°
C to
+
70
°
C)
Value
*1 : t
CYC
represents the frequency of one clock cycle including the gear period.
*2 : The values shown represent standards for
×
1 gear period.
For gear period settings of 1/2, 1/4, 1/8, use the following formula replacing n with the value 1/2, 1/4, 1/8
respectively.
(1/2
×
1/n)
×
t
CYC
10
*3 : The values shown represent standards for
×
1 gear period.
(3) Reset and Hardware Standby Input Standards
(V
CC
=
3.0 V to 3.6 V , V
SS
=
AV
SS
=
0 V, T
A
=
0
°
C to
+
70
°
C)
Value
* : INIT input time (at power-on)
FAR, Ceralock:
Crystal:
φ
: Power on
→
X0/X1 period
×
2
φ
×
2
15
or greater recommended
φ
×
2
21
or greater recommended
Parameter
Symbol
Pin name
Conditions
Unit
Remarks
Min
Max
Cycle time
MCLK
↑→
MCLK
↓
SYSCLK
↑→
SYSCLK
↓
MCLK
↓→
MCLK
↑
SYSCLK
↓→
SYSCLK
↑
t
CYC
MCLK, SYSCLK
t
CPT
ns
*1
t
CHCL
MCLK, SYSCLK
1/2
×
t
CYC
3
1/2
×
t
CYC
+
3
ns
*2
t
CLCL
MCLK, SYSCLK
1/2
×
t
CYC
3
1/2
×
t
CYC
+
3
ns
*3
Parameter
Symbol
Pin
name
Conditions
Unit
Remarks
Min
t
CP
×
5
Max
Hardware standby input time
t
HSTL
HST
ns
INIT input time
(power-on)
t
INTL
INIT
*
ns
INIT input time
(other than power-on)
t
CP
×
5
ns
MCLK, SYSCLK
V
OH
V
OL
V
OH
t
CYC
t
CLCH
t
CHCL
INIT
0.2 V
CC
t
RSTL
, t
HSTL
, t
INTL
HST
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PDF描述 |
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